版图设计总结

【版图学习笔记】

一．Candence操作 二．DESIGN RULE 三．各器件简述 四．版图技巧 五．布局布线 六．版图流程 七．ELLA的心得

Candence操作 一．进入版图工作环境：

1.进入unit ：Xmanger1.3..9＝》Xbrowser＝》EDA4＝》用户名＝》密码 2． 界面上右键－》tools－》terminal－》 3． 在layout目录输入icfb 登陆Candence

icfb后面加“ & ”的作用是之后可以继续在Shell窗口操作命令 4． 在icfb窗口 tools－》library manager－》选择library，cell，view。

如果是新建，则FILE－》new里面新建。 5．在icfb窗口的tools－》library path 可以加库

二．最常用快捷键： f:全景图

ctrl＋z：放大 shift＋z：缩小

shift＋f：详细版图（非symbol） u：undo

w：上一界面 i：调用器件 q：看属性 r：画矩形

p：固定长度的可折线

l：lable 标注端口、电源、地等。所标识的金属层，用该层TEXT层标识。如，M

苏州市职业大学工科类毕业论文(设计)

摘要

静电放电(简写为ESD)是集成电路(简写为IC)在制造、运输、以及使用过程中经常发生并导致IC芯片损坏或失效的重要原因之一。工业调查表明大约有40％的IC失效与ESD/EOS(过强的电应力)有关。因此，为了获得性能更好更可靠的IC芯片，对ESD开展专门研究并找到控制方法是十分必要的。随着芯片尺寸的持续缩小，ESD问题表现得更加突出，已成为新一代集成电路芯片在制造和应用过程中需要重视并着力解决的一个重要问题。

论文论述了CMOS集成电路ESD 保护的必要性，研究了在CMOS电路中ESD 保护结构的设计原理，分析了该结构对版图的相关要求，重点讨论了在I/O电路中ESD 保护结构的设计要求。

论文所做的研究工作和取得的结果完全基于GGNMOS的器件物理分析，是在器件物理层次上研究ESD问题的有益尝试；相对于电路层次上的分析结果，这里的结果更加准确和可靠，可望为GGNMOS ESD保护器件的设计和制造提供重要参考。

关键词：静电放电(ESD)；接地栅NMOS；保护器件；电源和地

1

苏州市职业大学工科类毕业论文(设计)

Abstract

The electrostatic discharge (ESD) i

沈阳理工大学课程设计

目录

1绪论............................................................................................................................. 2 1.1 设计背景 ............................................................................................................. 2 1.2 设计目标 ............................................................................................................. 2 2与门电路设计............................................................................................................. 3 2.1电路原理 ...............

1、什么是版图设计？版图设计的依据有那些？

按照电路的要求和一定的工艺参数，设计出元件的图形,并进行排列互连，以设计出一套 供IC制造工艺中使用的光刻掩膜版的图形，称为版图或工艺复合

版图设计依据：一定功能的电路结构；一定的工艺规则；可制造性

2简述采用标准单元技术的集成电路设计流程。

功能定义与说明 设计者或高级综合设计系统 用户设计逻辑图 逻辑图输入单元逻辑符号库 逻辑模拟、时序模拟单元电路功能库 标准单元单元拓扑库布局、布线 设计系统 提取布线寄生参数工艺、电学参数 生成测试向量逻辑模拟、时序模拟 转换拓扑图为掩模版版图单元版图库 生产厂家芯片制造 3比较接触孔（contact）和通孔（via）的异同。

接触孔特指最低层金属孔，用于将最低层金属和多晶硅或者扩散层连接起来。 而通孔则是指允许更高层金属进行相互连接的孔

4什么是版图设计规则？解释?设计规则？采用这种设计规则的优点和缺点？

考虑器件在正常工作条件下，根据实际工艺水平和成品率要求，给出的一组同一工艺层及不同工艺层之间几何尺寸的限制，主要包括线宽、间距、覆盖、露头、凹口、面积等规则，分别给他们的最小值，以防止掩模图形的断裂、连接和一些不

四．版图技巧Z 1．对敏感线的处理

对敏感线来说，至少要做到的是在它的走线过程中尽量没有其他走线和它交叉。因为走线上的信号必然会带来噪声，交错纠缠的走线会影响敏感线的信号。

对于要求比较高的敏感线，则需要做屏蔽。具体的方法是，在它的上下左右都连金属线，这些线接地。比如我用M3做敏感线，则上下用M2和M4重叠一层，左右用M3走，这些线均接地。等于把它像电缆一样包起来。

2．匹配问题的解决

电路中如果需要匹配，则要考虑对称性问题。比如1：8的匹配，则可以做成3×3的矩阵，“1”的放在正中间，“8”的放在四周。这样就是中心对称。如果是2：5的匹配，则可以安排成AABABAA的矩阵。

需要匹配和对称的电路器件，摆放方向必须一致。周围环境尽量一致。

3．噪声问题的处理

噪声问题处理的最常用方法是在器件周围加保护环。

Nmos管子做在衬底上 因此周围的guardring是Pdiff，在版图上是一层PPLUS,上面加一层DIFF，用CONTACT连M1。Pdiff接低电位。

Pmos管子做在NWELL里面 因此周围的GUARDING是Ndiff，在版图上先一层NPLUS，上面加一层DIFF，用CONTACT

1、 开机后，修改系统时间为当前时间。 2、 启动虚拟机程序

3、 进入虚拟机主界面，选择file——open

4、 找到cadence径向文件

5、 单击如图按钮

6、 进入如下图界面，同时按下ctrl，Alt和回车键，全屏显示，用户名：jcdl或lxb 码：123456

7、 输入用户名和密码，回车后，进入以下界面。

8、 在桌面右键，选择第一个选项open terminal，启动命令行格式

密

9、 cd回车，确保最根目录下，输入icfb回车

10、 启动cadence，选择tools——library manager

11、 进入下图界面

12、 新建一个库。

13、 取名：new，然后点击ok按钮

14、 选择第二项，Attach to a existing techfile，然后点击ok按钮。

目 录

第1章 N/P MOS晶体管的版图设计

教学导航 ................................................................................................................................. 13 情境1 N/P MOS晶体管的版图设计 .................................................................................... 13 1.1 项目创建 .......................................................................................................................... 13

1.1.1 软件环境设置 ....................................................................... 错误！未定义书签。 1.1.2 工艺文件导入 ...............

cadence快捷键总结 2009-03-28 11:10

Cadence版图布局软件Virtuso Layout Editor快捷键归纳(也就是Virtuso中说的Bindkey)

写在前面：以下我所归纳的快捷键是我在版图培训时通过阅读Cadence帮助文件和菜单命令一个个试出来的，有些我只知道作用而暂时想不到相应的中文翻译。还有一些快捷键帮助文件中有，但我试了没用，可能是要在Unix下吧^_^。希望对学版图设计的有所帮助吧。有不妥的地方还请多多指教啊。 首先介绍下鼠标操作吧。

单击左键选中一个图形(如果是两个图形交叠的话，单击左键选中其中一个图形，再单击选中另一个图形)

用左键框选，选中一片图形，某个图形要被完全包围才会被选中。

中键单击调出常用菜单命令(很少用，要点两下，麻烦。我们有快捷键的嘛) 右键点击拖放用来放大。放大后经常配合F键使用，恢复到全部显示。配合Tab键使用，平移视图。右键还有“Strokes”，就是点住右键画些图线，就能实现调用某些命令。

Shift+左键加选图形，Ctrl+左键减选图形。(Cadence菜单中大写表示+按shift，Ctrl写成^) F1 显示帮助窗口。 F2 保存。

F3 这个快捷

集成电路版图设计

班级 姓名 学号

摘要：介绍了集成电路版图设计的各个环节及设计过程中需注意的问题，然后将IC版图设计与PCB版图设计进行对比，分析两者的差异。最后介绍了集成电路版图设计师这一职业，加深对该行业的认识。

关键词: 集成电路版图设计 PCB版图设计 版图设计师

Abstract

Introduces the integrated circuit layout design each link and the problems needing attention in the design process, and then the IC layout design and PCB layout design are compared, analyzed the differences. Finally introduced the IC Layout Designer this occupation, deepen the understanding of the industry.

Keyw

版图设计

IC工艺和版图设计第二章 版图设计规则

主讲：莫冰Email:mobing@ 华侨大学信息学院电子工程系厦门专用集成电路系统重点实验室

版图设计

参考文献1 . Alan Hastings著 . 张为 译 . 模拟电路版 图的艺术.第二版 . 电子工业出版社 . CH2-3

2 . R.Jacobs Baker著 . 陈中建 译 . CMOS电路 设计布局与仿真 . 第一版. 机械工业出版社.CH2-4 3 . Michael Quirk 著 . 韩郑生 译 . 半导体制 造技术 . 第一版 . 电子工业出版社 . CH4、CH9 4 . CSMC 0.5um DPTM Mixed Signal Technology Technology Topological Design Rule

华侨大学厦门专用集成电路系统重点实验室

Copyright by Mo Bing

版图设计

本章主要内容

版图层次定义

Layout

版图设计规则 简单反相器版图

华侨大学厦门专用集成电路系统重点实验室

Copyright by Mo Bing

版图设计

版图层次定义Layout 1. 有源区 2.N阱 3. 场注入 4. 正常Vth沟道注入 5. 低Vth NMOS沟道注入 6.