智能触发器使用教程

SQL触发器使用教程和命名规范

1，触发器简介

触发器（Trigger）是数据库对象的一种，编码方式类似存储过程，与某张表（Table）相关联，当有DML语句对表进行操作时，可以引起触发器的执行，达到对插入记录一致性，正确性和规范性控制的目的。在当年C/S时代盛行的时候，由于客户端直接连接数据库，能保证数据库一致性的只有数据库本身，此时主键（Primary Key），外键（Foreign Key），约束（Constraint）和触发器成为必要的控制机制。而触发器的实现比较灵活，可编程性强，自然成为了最流行的控制机制。到了B/S时代，发展成4层架构，客户端不再能直接访问数据库，只有中间件才可以访问数据库。要控制数据库的一致性，既可以在中间件里控制，也可以在数据库端控制。很多的青睐Java的开发者，随之将数据库当成一个黑盒，把大多数的数据控制工作放在了Servlet中执行。这样做，不需要了解太多的数据库知识，也减少了数据库编程的复杂性，但同时增加了Servlet编程的工作量。从架构设计来看，中间件的功能是检查业务正确性和执行业务逻辑，如果把数据的一致性检查放到中间件去做，需要在所有涉及到数据写入的地方进行数据一致性检查。由于数据库访问相对于中间件

4.6 触发器使用中应注意的问题

4.6.1 触发器的电路结构与逻辑功能的关系

在 图4-6-1中, 图(a)所示为同步触发器。同步触发器在CP高电平的全部时间内，都可以接收输入信号并改变输出状态，属于电平触发方式。图示为高电平触发，要求在CP＝l时输入信号保持不变，以防空翻。

图(b)所示为主从JK触发器，只在CP下降沿时改变状态，能克服空翻。但它在CP＝1期间也可接收并存储输入信号，所以要求CP＝l时JK保持不变，以防误翻。它在CP＝l的全部期间内都可以接收输入端的噪声干扰，故抗干扰能力差。JK触发器属于主从触发方式，CP下降沿时翻转。

图(c)所示为利用传输延迟时间的TTL边沿JK触发器，只在CP下降沿时改变状态，而且它只在极短时间内接收输入信号，只要这时J、K保持不变即可。故接收输入端噪声干扰的时间极短，只有1tpd 。 抗干扰能力强。它属于边沿触发方式，CP下降沿触发。

图(d)所示为CMOS边沿JK触发器，也是边沿触发方式；但它是CP上升沿触发。要求在CP上升沿来到之前，J、K信号在tset内保持不变。它接收输入干扰的时间也只有tset，故抗干扰能力也较强。

图(e)所示为维持阻塞D触发器，采用边

4.6 触发器使用中应注意的问题

4.6.1 触发器的电路结构与逻辑功能的关系

在 图4-6-1中, 图(a)所示为同步触发器。同步触发器在CP高电平的全部时间内，都可以接收输入信号并改变输出状态，属于电平触发方式。图示为高电平触发，要求在CP＝l时输入信号保持不变，以防空翻。

图(b)所示为主从JK触发器，只在CP下降沿时改变状态，能克服空翻。但它在CP＝1期间也可接收并存储输入信号，所以要求CP＝l时JK保持不变，以防误翻。它在CP＝l的全部期间内都可以接收输入端的噪声干扰，故抗干扰能力差。JK触发器属于主从触发方式，CP下降沿时翻转。

图(c)所示为利用传输延迟时间的TTL边沿JK触发器，只在CP下降沿时改变状态，而且它只在极短时间内接收输入信号，只要这时J、K保持不变即可。故接收输入端噪声干扰的时间极短，只有1tpd 。 抗干扰能力强。它属于边沿触发方式，CP下降沿触发。

图(d)所示为CMOS边沿JK触发器，也是边沿触发方式；但它是CP上升沿触发。要求在CP上升沿来到之前，J、K信号在tset内保持不变。它接收输入干扰的时间也只有tset，故抗干扰能力也较强。

图(e)所示为维持阻塞D触发器，采用边

GDOU-B-11-112

广东海洋大学学生实验报告书

实验名称 实验11：使用触发器加强完整性 课程名称 学院（系） 学生姓名

数据库原理及应用

成绩

软件学院

专业

软件工程

班级

实验日期

学号 实验地点

实验目的：

1. 掌握after和Instead of触发器的使用方法 实验内容

1. 创建触发器，当修改Orders表中某行数据的mShippingCharges和mGiftWrapCharges时，要

修改相应行的总价mTotalCost，以保证结果的正确性。 CREATE TRIGGER trigTotalCost ON Orders AFTER UPDATE AS BEGIN

IF (UPDATE(mShippingCharges) OR UPDATE(mGiftWrapCharges)) BEGIN END END

2. 创建after触发器，禁止删除ToysBrand表中的记录。

CREATE TRIGGER trigForbidDeleteBrand ON ToyBrand AFTER DELETE AS BEGIN

PRINT 'ToyBrand 表中的记录不能被删除' R

GDOU-B-11-112

广东海洋大学学生实验报告书

实验名称 实验11：使用触发器加强完整性 课程名称 学院（系） 学生姓名

数据库原理及应用

成绩

软件学院

专业

软件工程

班级

实验日期

学号 实验地点

实验目的：

1. 掌握after和Instead of触发器的使用方法 实验内容

1. 创建触发器，当修改Orders表中某行数据的mShippingCharges和mGiftWrapCharges时，要

修改相应行的总价mTotalCost，以保证结果的正确性。 CREATE TRIGGER trigTotalCost ON Orders AFTER UPDATE AS BEGIN

IF (UPDATE(mShippingCharges) OR UPDATE(mGiftWrapCharges)) BEGIN END END

2. 创建after触发器，禁止删除ToysBrand表中的记录。

CREATE TRIGGER trigForbidDeleteBrand ON ToyBrand AFTER DELETE AS BEGIN

PRINT 'ToyBrand 表中的记录不能被删除' R

基 于 CMOS 的 D 触 发 器 的 设 计

一、设计目的：

1、进一步熟悉cadence软件的使用； 2、掌握cadence的原理图编辑及修改方法； 3、掌握cadence前仿的参数设置和方法； 4、掌握D触发器的功耗、截止频率和瞬态仿真。

二、设计和原理：

触发器是一个具有记忆功能的二进制信息存储器件，是构成多种时序电路的最基本逻辑单元。D触发器在CLK 有效电平期间将D的状态输出。用CMOS 做器件是集成电路的发展方向。本次实验设计是用MOS 器件设计一个D触发器。通过D触发器的功能设计电路图，再转换为MOS 器件的电路。

设计主要是根据D触发器的特性来设计的。根据它的特性表画原理图

D触发器的功能表如下；

当CLK = 1 时触发器的Q*=D；当CLK = 0，触发器将保持不变，即Q*=Q。

D触发器的原理图：

和主要参数：

三、设计仿真：

1、瞬态仿真 ①放参数设置

②仿真结果

2、功耗仿真 ①电流波形

②平均电流值

数字电路实验报告

实验三 RS触发器与集成触发器

一、实验目的

1、掌握触发器的逻辑功能及其测试方法； 2、学习触发器简单的典型应用。 二、实验器材

1、直流稳压电源、数字逻辑电路实验箱、万用表、示波器； 2、74LS00、74LS02、74LS04、74LS74、74LS76（或74LS112）。 三、实验原理

1、基本RS触发器

用与非门（74LS00）构成的基本RS触发器 如图3-1（a）所示，R、S端为低电平有效； 用或非门（74LS02）构成的基本RS触发器 如图3-1（b）所示，R、S端为高电平有效。

2、集成D触发器

触发器的复位和置位功能：

只要R L,不论其他输入是何种状态， 触发 器的输出立即强制变成Q H，同时Q L；只 要S L，不论其他输入是何种状态触发器的输 出立即强制变成Q H，同时Q L。复位和 置位完成后，必须使 H和S H。 3、JK触发器

当CP=0时，R=S=1，触发器维持原状态不变； 当CP=1时，Qn 1 JQ KQ，即为 J=0，Q=0，Qn 1 Q； J=0，K=1，Qn 1 0； J=1，K=0，Qn 1 1； J=1，K=1，Qn 1 Q；

四、实验内容和步骤

根据电路图建立

一、实验目的

1）理解触发器的用途、类型和工作原理

2）掌握利用T-SQL语句创建和维护触发器的方法 3）掌握利用企业管理器创建、维护触发器的方法

二、实验内容

说明：在所有触发器取名时，请各位同学在所给定的名称后加上下划线及学号后四位数字构成自己的实验触发器名。如：deltr_20051101.各触发器中的所用到的参数变量名自取。 1、利用企业管理器创建与维护触发器 （1）创建简单触发器

创建一个触发器stu_modify在修改student表后，显示一个提示信息，告诉用户有多少行数据被修改了。 创建步骤：

create trigger stu_modify on student

after insert,delete,update as

print '（所影响的行数为:'+cast(@@rowcount as varchar(10))+'行'; 触发器的触发执行测试语句（T-SQL）：

update Student_20083386 set sex='男'

where sno='20050001'

执行结果：

（2）修改触发器

修改stu_modify触发器，使其为一个加密触发器。（提示：加wit

单稳态触发器

单稳态触发器只有一个稳定状态，在外加脉冲的作用下，单稳态触发器可以从一个稳定状态翻转到一个暂态，该暂态维持一段时间又回到原来的稳态。

一、用555定时器构成单稳态触发器：

1.电路组成

如图6-7所示，其中R、C为单稳态触发器的定时元件，它们的连接点Vc与定时器的阀值输入端（6脚）及输出端Vo'（7脚）相连。单稳态触发器输出脉冲宽度tpo=1.1RC。

Ri、Ci构成输入回路的微分环节，用以使输入信号Vi的负脉冲宽度tpi限制在允许的范围内，一般tpi>5RiCi，通过微分环节，可使Vi'的尖脉冲宽度小于单稳态触发器的输出脉冲宽度tpo。若输入信号的负脉冲宽度tpi本来就小于tpo，则微分环节可省略。 定时器复位输入端（4脚）接高电平，控制输入端Vm通过0.01uF接地，定时器输出端Vo（3脚）作为单稳态触发器的单稳信号输出端。

2.工作原理

单稳态触发器

当输入Vi保持高电平时，Ci相当于断开。输入Vi'由于Ri的存在而为高电平Vcc。此时，①若定时器原始状态为0，则集电极输出（7脚）导通接地，使电容C放电、Vc=0，即输入6脚的信号低于2/3Vcc，此时定时器维持0不变。

②若定时器原始状态为1，则集电极输出（7脚）对地断开，Vc

一、判断题

1、用逻辑门构成的各种触发器均属于电平异步时序逻辑电路 （ ）

2、RS、JK、D和T四种触发器中，唯有RS触发器存在输入信号的约束条件 （ ） 3、与非门的输入端加有低电平时，其输出端恒为高电平。（ ） 4、数字电路可以分为组合逻辑电路和时序逻辑电路两大类。（ ）

5、时序逻辑电路中存在反馈，其输出不仅取决于当时的输入，还与电路的上一个状态有关。（ ） 6、组合逻辑电路的输出只与当时的输入有关，与电路的上一个状态无关，没有记忆功能。（ ） 7、触发器是时序逻辑电路的基本单元。（ ）

8、时序逻辑电路由组合逻辑电路和存储电路构成。（ ）

9、触发器的反转条件是由触发输入与时钟脉冲共同决定的。（ ）

10、组合逻辑电路任何时刻的输出不仅与该时刻的输入状态有关，还与先前的输出状态有关。（ ）

11、译码器、比较器属于组合逻辑电路。

12、数字电路可分为组合逻辑电路和时序逻辑电路。

13、全加器是实现两个1位二进制数相加并考虑低位进位的逻辑电路。 14、实现同一逻辑功能的逻辑电路可以不同 15、译码是编码的逆过程。

16、寻找组合逻辑电路输入输出关系表达式的过程和方法,是组合逻辑电路的设计过程. 17、公式化