数字跑表课程设计EDA
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EDA - 数字跑表课程设计(1) - 图文
EDA课程设计报告
数字跑表
学院:机械与电子工程学院
专业:电子科学与技术 学号:1020630208 姓名:熊 ……
一:设计目的:
(1)学会利用QuartusⅡ发热宏单元和所学的数字电路知识,搭建复杂一点的数字电路或系统。
(2)学会使用EDA的程序语言FPGA/CPLD设计数字跑表,设计主要包括功能分析、方案设计和电路测试几个步骤。
二:设计内容:
1.设计一个数字跑表,具有如下功能。 (1)复位和暂停,秒表计时等功能。
(2)跑表计时长度可达1小时,计时精度为0.01 秒。 (3)通过6位数码管分别显示跑表的分、秒和百分秒。
控制端 复位(clr) 取值 1 0 计数/暂停键(pause) 1 0
2.方案论证:
数字跑表设三个输入端,分别为时钟输入(CLK),复位(CLR),启动、暂停按键(PUSE)。复位信号高电平有效,可对跑表异步清零;当启动、暂停键为低电平时跑表开始计时,为高电平时暂停,变低后在原来的数值基础上继续计数。数字跑表的结构示意图如下:
功能 异步清零 计数 暂停 计数
图2-1跑表示意图
3.模块电路设计:
FPGA数字跑表课程设计
基于FPGA的数字跑表的设计
摘 要
本设课程设计是基于FPGA的数字跑表的设计,利用Verilog HDL语言和Quartus II软件以及FPGA实验操作平台来实现的。本论文的重点是用硬件语言Verilog HDL 来描述数字跑表,偏重于软件设计。大致内容是首先简单介绍了EDA的现状和前景, Verilog HDL 语言特点,应用平台FPGA,之后阐述了数字跑表的设计思想和大体的设计流程,最后进入本设计的核心设计部分,用Verilog HDL 语言设计数字跑表电路,着重对各个模块进行了详细的分析和说明。
【关键词】Verilog HDL 语言;Quartus II 软件;数字秒表
- 1 -
基于FPGA的数字跑表的设计
目 录
1 绪论 ·································································································· 2
1.1 EDA的现状和发展及FPGA简介 ············································· 2 1.2 Verilog HDL语言及QuartusⅡ
FPGA数字跑表课程设计
基于FPGA的数字跑表的设计
摘 要
本设课程设计是基于FPGA的数字跑表的设计,利用Verilog HDL语言和Quartus II软件以及FPGA实验操作平台来实现的。本论文的重点是用硬件语言Verilog HDL 来描述数字跑表,偏重于软件设计。大致内容是首先简单介绍了EDA的现状和前景, Verilog HDL 语言特点,应用平台FPGA,之后阐述了数字跑表的设计思想和大体的设计流程,最后进入本设计的核心设计部分,用Verilog HDL 语言设计数字跑表电路,着重对各个模块进行了详细的分析和说明。
【关键词】Verilog HDL 语言;Quartus II 软件;数字秒表
- 1 -
基于FPGA的数字跑表的设计
目 录
1 绪论 ·································································································· 2
1.1 EDA的现状和发展及FPGA简介 ············································· 2 1.2 Verilog HDL语言及QuartusⅡ
EDA课程设计 - 数字时钟 2
EDA课程设计报告
设计题目:专 业:姓 名:学 号:指导老师:
数字时钟设计 通信技术 瞿鹏航 12015170
虞沧
前 言
随着基于PLD的EDA技术的发展和应用领域的扩大和深入,EDA技术在电子信息、通信、自动控制及计算机应用领域的重要性日益提高。
作为现在的大学生应熟练掌握这门技术,为以后的发展打下良好的基础,本实验设计是应用QuartusII环境及VHDL语言设计一个时间可调的数字时钟。使自己熟练使用QuartusII环境来进行设计,掌握VHDL语言的设计方法。要注重理论与实践之间的不同,培养自己的实践能力!
一、课程设计任务及要求
1.1实验目的
1)掌握VHDL语言的基本运用
2)掌握QuartusII的简单操作并会使用EDA实验箱 3)掌握一个基本EDA课程设计的操作
1.2功能设计
1)有时、分、秒计数显示功能,小时为24进制,分钟和秒为60进制以24小时循环计时
2)设置复位、清零等功能
3)有校时功能,可以分别对时及分进行单独校时,使其校正到标准时间 4)时钟计
EDA课程设计数字时钟 - 图文
序号
优秀( )良好( ) 综合成绩 中等( )及格( ) 不及格( ) 教师(签名) 批改日期
《EDA技术》课程设计报告
课题: 数字电子钟逻辑电路设计
院系 电子与电气工程学院 专业 电气工程及其自动化 班级 学号
姓名
指导教师 杨银贤、王文杰、叶晓婷、王晓辉
起止日期 2014-12-18至2014-12-19
2014年 12 月
目录
一、课程设计任务及要求............................................................................................ 1
1.1实验目的.......................................................................................................... 1 1.2功能
EDA课程设计数字密码锁
目录
目录 ........................................................................................................................................................................ 1 摘要 ........................................................................................................................................................................ 2 关键词 .................................................................................................................................................................... 2 1 引言 .
EDA课程设计
用VHDL语言实现数字钟的设计
2011年12月21日
一、EDA课程设计的目的与任务
(一)、掌握利用可编程逻辑器件和EDA设计工具进行电子系统设计的方法,内容包括:
(1)VHDL程序设计、输入——在ise平台上用VHDL描述系统的功能 (2)逻辑综合——将源程序编译后,为设计系统选择一个电路实现方案,按照这个方案进行逻辑综合和优化,生成1个电路网表文件
(3)功能仿真——检查自己的设计是否达到和完成要求的逻辑功能
(4)设计实现——布局、布线及配置,最后生成可以写到芯片中的目标文件 (5)时序仿真——是适配到选定的芯片后进行的仿真,它模拟芯片的实际动作,仿真时间模型严格将门级延时计算在内,可以分析出竞争与冒险,时序仿真验证过的电路与实际电路基本上已致。 (6)器件编程——对器件编程下载 (7)测试
二、EDA课程设计的要求
设计实现一个具有带预置数的数字钟,具有显示年月日时分秒的功能。用6个数码管显示时分秒,set按钮产生第一个脉冲时,显示切换年月日,第2个脉冲到来时可预置年份,第3个脉冲到来时可预置月份,依次第4、5、6、7
用VHDL语言实现数字种的设计
个脉冲到来时分别可预置日期、时、分、秒,第 8个脉冲到来后预
EDA课程设计
河北科技大学
课程设计报告
学生姓名: 学 号: 专业班级: 电信 课程名称: EDA技术
学年学期: 2013—2014 学年 第二学期
指导教师: 安国臣
2 0 14年 6月
课程设计成绩评定表
学生姓名 专业班级 设计题目 电梯控制器设计 指 导 教 师 评 语 指导教师: 安国臣 年 月 日 电信 学 号 起止时间 成绩 2014年6月16日—6月20日
目录
1.设计题目 2.设计目的 3.设计内容 4.设计原理 5.具体程序说明 6.实现的功能及运行规则 7.编译与仿真波形 8.硬件测试 9.设计体会 10.附录
引言
电梯控制
EDA课程设计
在系统编程技术课程设计 课程名称任课教师设计题目班级 姓名 学号 日期 在系统编程技术 谭敏 出租车自动计费器 05自动化(1)班 王娜 0510203027 2008年1月1日
1
出租车自动计费器EDA设计
1、题目分析
1.1 设计要求
设计一个出租车自动计费器,计费包括起步价、行车里程计费、等待时间计费3部分;用3位数码管显示金额,最大值为999.9元,最小计价单元为0.1元,行程3公里内,且等待时间3分钟以内,起步价为8元,超过3公里,以每公里1.6元计费,等待时间单价为每分钟1元;用两位数码管显示总里程,最大为99公里,用两位数码管显示等待时间,最大值为59MIN。
1.2设计原理
根据层次化设计理论,该设计问题自顶向下可分为分频模块、控制模块、计量模块、译码和动态扫描显示模块,其系统框图如下图所示,各模块功能如下所述。 FPGA
时钟信号 分频器 计费 译码 显示 等待信号 控制器 公里脉冲
EDA课程设计
河北科技大学
课程设计报告
学生姓名: 学 号: 专业班级: 电信 课程名称: EDA技术
学年学期: 2013—2014 学年 第二学期
指导教师: 安国臣
2 0 14年 6月
课程设计成绩评定表
学生姓名 专业班级 设计题目 电梯控制器设计 指 导 教 师 评 语 指导教师: 安国臣 年 月 日 电信 学 号 起止时间 成绩 2014年6月16日—6月20日
目录
1.设计题目 2.设计目的 3.设计内容 4.设计原理 5.具体程序说明 6.实现的功能及运行规则 7.编译与仿真波形 8.硬件测试 9.设计体会 10.附录
引言
电梯控制