eda实验4
更新时间:2024-05-21 17:23:02 阅读量: 综合文库 文档下载
电子信息工程学系实验报告
课程名称:EDA技术与实验
实验项目名称:简单分频时序逻辑电路的设计 实验时间:2012.9.19 班级:通信101 姓名: *** 学号:0107051**
指导教师(签名): 翁亚滨 成 绩: 实 验 目 的:
1、掌握基本的时序逻辑电路的实现方法。 2、初步了解分频时序逻辑电路的生成方法。
3、过程赋值有阻塞(blocking)赋值和非阻塞(non_blocking)赋值两种方式。 4、学习顺序执行和并发执行。
实 验 环 境: Windows x p 、MAX+plusⅡ软件。
实 验 内 容 及 过 程:
一、测试模块的编写,模块调用的仿真:
1、按屏幕上方的“新建文件”按钮,或选择菜单“File”→“New”,出现如图3-1所示的对话框,在框中选中“Text Editor file”,按“OK”按钮,即选中了文本编辑方式。如图4-1
2、此时系统未能识别以何种语言进行文本编辑,需先保存所使用语言的文本文件,命名“half”保存时后缀应为.v 。
3、在编辑窗口中输入程序,程序如图4-2所示:
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图4-2
4、在 File menu 菜单中选择 Project Name项,将出现Project Name 对话框, 在 Files 框内,选择您的设计文件。选择 OK
5、 在 File菜单中选择 Create Default Symbol 项,即可创建一个设计的符号。该符号可被高层设计调用。在 MAX+PLUS II 菜单内选择Compiler 项。则出现编译器窗口,选择 Start即可开始编译, MAX+PLUS II 编译器将检查项目是否有错。如图4-3所示。
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图4-3
6、选择菜单“File”→“New”,在出现的“New”对话框中选择“Waveform Editor File”,按“OK”后将出现波形编辑器子窗口。如图4-4所示。
图4-4
7、选择菜单“Node ” →“Enter Nodes from SNF”,出现如图3-7所示的选择信号结点对话框。按右上侧的“List”按钮,左边的列表框将立即列出所有可以选择的信号结点,然后按中间的“=>”按钮,将左边列表框的结点全部选中到右边的列表框,按“OK”按钮,选中的信号将出现在波形编辑器中。如图4-5
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图4-5
8、 波形观察窗左排按钮是用于设置输入信号的,使用时只要先用鼠标在输入波形上拖一需要改变的黑色区域,然后点击左排相应按钮即可。设置好输入波形并保存后,选择主菜单“MAX+plus II”→“Simulator”,按下“Simulator”,出现仿真参数设置与仿真启动窗(如图4-6所示),这时按下该窗口中的“Start”按钮,即刻进行仿真运算.仿真结果如图4-7所示。
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图4-6
图4-8 二、
顺序执行和并发执行(应用阻语塞句)和并发执行(应用非阻塞语句)
说明:
{以下图中有标:图(a)表顺序执行,图(b)表并发执行(应用阻语塞句),图(c)并发执行(应用非阻塞语句)}
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1、按屏幕上方的“新建文件”按钮,或选择菜单“File”→“New”,出现如图3-1所示的对话框,在框中选中“Text Editor file”,按“OK”按钮,即选中了文本编辑方式。
2、另存为Verilog编辑文件,命名为“serial1和serial2,serial3”, 保存时后缀应为.v 。
3、在编辑窗口中输入程序,如图4-9(a),(b),(c)所示:
(a)
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(b)
(c)
图4-9
4、在 File menu 菜单中选择 Project Name项,将出现Project Name 对话框, 在 Files 框内,选择您的设计文件,选择 OK 。
5、在 File菜单中选择 Create Default Symbol 项,在 MAX+PLUS II 菜单内选择Compiler 项。则出现编译器窗口,选择 Start即可开始编译, MAX+PLUS II 编译器将检查项目是否有错,如图4-10所示。
(a)
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(b)
(c)
图4-10
6、选择菜单“File”→“New”,在出现的“New”对话框中选择“Waveform Editor File”,按“OK”后将出现波形编辑器子窗口。
7、选择菜单“Node ” →“Enter Nodes from SNF”,选择信号结点对话框。按右上侧的“List”按钮,左边的列表框将立即列出所有可以选择的信号结点,如图4-11所示,然后按中间的“=>”按钮,将左边列表框的结点全部选中到右边的列表框。按“OK”按钮,选中的信号将出现在波形编辑器中。
(a)
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(b)
(c)
图4-11
8、设置好输入的数据后并保存后,选择主菜单“MAX+plus II”→“Simulator”,按下“Simulator”,出现仿真参数设置与仿真启动窗,这时按下该窗口中的“Start”按钮,即刻进行仿真运算.仿真结果如图4-12所示:
(a)
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(b)
(c) 图4-12
二、实 验 结 果 及 分 析::1/2分频器仿真结果图4-8所示。顺序执行,并发执行(应用阻塞语句)和并发
执行(应用非阻塞语句)的仿真结果分别为图4-12的(a)、(b)、(c)
实 验 心 得:通过这次实验,学会了MAX+plusⅡ软件设计比较器,通过比较对照,及与同学的相互交流,学会了如何使用编写模块代源。同时理解什么为顺序执行,并发执行,明白如何阻塞语句和非阻塞语句的不同及应。
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