DDR2时序测试规范V1.0 - 图文

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DDR2时序测试规范

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DDR2时序测试规范

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DDR2时序测试规范

CONTENTS

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待测时序参数 -------------------------------------------------------------------------------------------- 1 地址和控制信号时序 ----------------------------------------------------------------------------------- 2 DQ读写数据分离 --------------------------------------------------------------------------------------- 6 写数据和DM信号时序 -------------------------------------------------------------------------------- 8 读数据时序 ---------------------------------------------------------------------------------------------- 13 时序修正-------------------------------------------------------------------------------------------------- 15

DDR2时序测试规范

1 待测时序参数

DDR2的时序测试应包括下表所列的基本参数：

地址和控制信号时序 Symbol tIS tIH 写数据和DM信号时序 tDS tDH tWPRE tWPST 读数据时序 tDQSQ tQH tRPRE tRPST Parameter Address and control input setup time Address and control input hold time DQ and DM input setup time DQ and DM input hold time DQS Write preamble，写前导时间 DQS Write postamble，写后续时间 DQS-DQ skew for DQS and associated DQ DQ output hold time from DQS DQS Read preamble，读前导时间 DQS Read postamble，读后续时间【备注】如果内存控制器（如CPU）的datasheet中对读数据时序有明确要求，读时序测试参考内存控制器的datasheet执行。

各参数的示意图如下：

DDR2时序测试规范

下面分别说明这些参数的测试方法。

2 地址和控制信号时序

包括tIS和tIH，定义如下：

本文来源：https://www.bwwdw.com/article/qkqv.html

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