OrCAD capture CIS

更新时间:2023-11-26 21:28:01 阅读量: 教育文库 文档下载

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OrCAD capture CIS

OrCAD模块构造成以及功能 Cadence OrCAD Capture CIS

Capture作为行业标准的PCB原理图输入方式,是当今世界最流行的原理图输入工具之一 CIS是capture基础上的一款元件库管理工具,它兼容几乎所有的主流数据库,可以和用户的管理系统结合,使得设计更加便捷。 Cadence Pspice A/D AA

Pspice A/D把行业领先的数模混合信号仿真技术相结合,为客户提供了一整套完整的电路仿真验证解决方案,Pspice AA高级模拟分析超越了电路的功能仿真,它融合了更多技术,用以改善设计性能,提高成本效益和可靠性。 Cadence OrCAD PCB Designer

Capture的PCB设计工具基于规则约束驱动,保证了PCB设计的高效,准确,其强大的功能和设计操作的便捷。

Cadence FPGA System planner

Cadence OrCAD FPGA系统设计平台提供了一套完整的,可扩展的FPGA-PCB协同式设计解决方案,用于板级FPGA设计,它能够自动对应交配置进行 芯片规则算法的综合优化 Cadence OrCAD signal Explorer

Cadence OrCAD信号探测器的信号探测,分析和验证功能可以帮助工程师在整个设计过程中从设计周期开始到布局布线处理信号完整性问题。 Cadence Active Parts portal

Cadence Active parts portal 是一个原件自动调用进行,扩展了Caputure CIS的原件信息管理功能。借助Active parts原件搜索简单易行,仅需点击数据表单即可,通过拖拉操作即可将得到的部件置于电路原理图中。

OrCAD原理图操作

电路图到产生网表输出

新建工程打开OrCAD capture CIS组件进入界面File→New project输入创建工程名字Name选择原理图选项Schematic→原则工程存放路径location,确认OK进入工作区开始画电路图。 原件添加元件库part ,常用原件discrete分立常用原件。

原件快捷添加件P 旋转方向快捷键R 左右对称镜像旋转快捷键H 上下镜像快捷键V 原理图绘图区放大 Zoom in 快捷键I 缩小Zoom out 快捷键O 删除原件 快捷键Det

连接线 place wire 快捷键(W) 总线 Bus 快捷键(B) 总线连接符 bus entry 快捷键(E)

进行总线网络命名A0→A3命名标号会自动跟鼠标,光标增加。总线网络快捷键N A【0..3】 原件换成另外方式现实,点击原件右键Edit part 。

给原件加标点→菜单place→Ellipse画远点后关闭,点击Update ALL所有相同元件更新一样远点。

如何设置生成网表

选中原件双击 出现原件信息表 点击PCB Footprint右键Edit输入封装编号如:R0805,C0805. 封装设置完成生成网表前要进行检查tools→Design Rules check设计规则检查。 原则原理图tools→Create Netlist生成网表。

整体生成网表→生成网表完成

PSpice仿真 流程

打开Capture CIS工具

新建工程project必须选择Analog or MixedA/D 只有它和PSPice仿真做关联。指定工程名字路径点击OK出现模板选择框。选择模板可以快速建立仿真工程。

查看工程模板电路图看参数设置点击→Edit simulation profile 设置仿真选项,设置OK后点击RUN pspice运行仿真 仿真流程完成。

进入仿真曲线界面点 toggle cursor切换光标 Evaluate Measurement 测量函数

Add Trace 设置过滤器可以查看原件功率信息。选择名称Det可以删除波形。 生成报告可以拷贝到Word文档中,仿真波形调整窗口大小所见即所得。 瞬态分析参数:观察不同时刻的不同输出波形,相当于示波器的功能。 直流扫描参数:让一个直流量在一定范围变化,观察其对电路输出的影响。

AC扫描参数设置:观察电路在不同频率下的输出响应,可以得到幅频及相频特性。 直流偏执点分析:观察电路的直流工作点情况,得到直流增益。

OrCAD制版流程

1. 2. 3. 4. 5.

绘制原理图,并且设置各个元器件的封装。 DRC检查,设置检查规则。 导出网表,Create Netlist。

PCB环境设置,Foorprint路径指定,outline设置。

打开PCB Editor,新建Board文件。在导入网表前先设置板子外形,边框距离等,导入网表,放置元器件。

6. 设置规则的约束器,指定各种布局布线规则。

本文来源:https://www.bwwdw.com/article/jalt.html

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