计算机组成原理第二版课后习题答案

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第1章计算机系统概论

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1. 什么是计算机系统、计算机硬件和计算机软件？硬件和软件哪个更重要？

解：

计算机系统：由计算机硬件系统和软件系统组成的综合体。

计算机硬件：指计算机中的电子线路和物理装置。

计算机软件：计算机运行所需的法度及相关资料。

硬件和软件在计算机系统中相互依存，缺一不成，因此同样重要。

2. 如何理解计算机的条理结构？

答：计算机硬件、系统软件和应用软件构成了计算机系统的三个条理结构。

（1）硬件系统是最内层的，它是整个计算机系统的基础和核心。

（2）系统软件在硬件之外，为用户提供一个基本操纵界面。

（3）应用软件在最外层，为用户提供解决具体问题的应用系统界面。

通常将硬件系统之外的其余层称为虚拟机。各条理之间关系密切，上层是下层的扩展，下层是上层的基础，各条理的划分不是绝对的。

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3. 说明高级语言、汇编语言和机器语言的不同及其联系。

答：机器语言是计算机硬件能够直接识另外语言，汇编语言是机器语言的符号暗示，高级语言是面向算法的语言。高级语言编写的法度（源法度）处于最高层，必须翻译成汇编语言，再由汇编法度汇编成机器语言（目标法度）之后才干被执行。

4. 如何理解计算机组成和计算机体系结构？

答：计算机体系结构是指那些能够被法度员所见到的计算机系统的属性，如指令系统、数据类型、寻址技术组成及I/O机理等。计算机组成是指如何实现计算机体系结构所体现的属性，包含对法度员透明的硬件细节，如组成计算机系统的各个功能部件的结构和功能，及相互连接办法等。

5. 冯?诺依曼计算机的特点是什么？

解：冯?诺依曼计算机的特点是：P8

●计算机由运算器、控制器、存储器、输入设备、输出设备五

年夜部件组成；

●指令和数据以同同等位置寄存于存储器内，并可以按地址拜

访；

●指令和数据均用二进制暗示；

●指令由操纵码、地址码两年夜部分组成，操纵码用来暗示操

纵的性质，地址码用来暗示操纵数在存储器中的位置；

●指令在存储器中顺序寄存，通常自动顺序取出执行；

●机器以运算器为中心（原始冯?诺依曼机）。

6. 画出计算机硬件组成框图，说明各部件的作用及计算机系统的

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主要技术指标。

答：计算机硬件组成框图如下：

各部件的作用如下：

控制器：整机的指挥中心，它使计算机的各个部件自动协调工作。

运算器：对数据信息进行处理的部件，用来进行算术运算和逻辑运算。

存储器：寄存法度和数据，是计算机实现“存储法度控制”的基础。

输入设备：将人们熟悉的信息形式转换成计算机可以接受并识另外信息形式的设备。

输出设备：将计算机处理的结果（二进制信息）转换成人类或其它设备可以接收和识另外信息形式的设备。

计算机系统的主要技术指标有：

机器字长：指CPU一次能处理的数据的位数。通常与CPU的寄存器的位数有关，字长越长，数的暗示规模越年夜，精度也越高。机器字长也会影响计算机的运算速度。

数据通路宽度：数据总线一次能并行传送的数据位数。

存储容量：指能存储信息的最年夜容量，通常以字节来衡量。一般包含主存容量和辅存容量。

运算速度：通经常使用MIPS（每秒百万条指令）、MFLOPS（每秒百万次浮点运算）或CPI（执行一条指令所需的时钟周期数）来

衡量。CPU执行时间是指CPU对特定法度的执行时间。

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主频：机器内部主时钟的运行频率，是衡量机器速度的重要参数。

吞吐量：指流入、处理和流出系统的信息速率。它主要取决于主存的存取周期。

响应时间：计算机系统对特定事件的响应时间，如实时响应外部中断的时间等。

7. 解释下列概念：

主机、CPU、主存、存储单位、存储元件、存储基元、存储元、存储字、存储字长、存储容量、机器字长、指令字长。

解：P910

主机：是计算机硬件的主体部分，由CPU和主存储器MM合成为主机。

CPU：中央处理器，是计算机硬件的核心部件，由运算器和控制器组成；（早期的运算器和控制器不在同一芯片上，现在的CPU 内除含有运算器和控制器外还集成了CACHE）。

主存：计算机中寄存正在运行的法度和数据的存储器，为计算机的主要工作存储器，可随机存取；由存储体、各种逻辑部件及控制电路组成。

存储单位：可寄存一个机器字并具有特定存储地址的存储单位。

存储元件：存储一位二进制信息的物理元件，是存储器中最小的存储单位，又叫存储基元或存储元，不克不及单独存取。

存储字：一个存储单位所存二进制代码的逻辑单位。

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存储字长：一个存储单位所存储的二进制代码的总位数。

存储容量：存储器中可存二进制代码的总量；（通常主、辅存容量分隔描述）。

机器字长：指CPU一次能处理的二进制数据的位数，通常与CPU的寄存器位数有关。

指令字长：机器指令中二进制代码的总位数。

8. 解释下列英文缩写的中文含义：

CPU、PC、IR、CU、ALU、ACC、MQ、X、MAR、MDR、I/O、MIPS、CPI、FLOPS

解：全面的回承诺分英文全称、中文名、功能三部分。

CPU：Central Processing Unit，中央处理机（器），是计算机硬件的核心部件，主要由运算器和控制器组成。

PC：Program Counter，法度计数器，其功能是寄存以后欲执行指令的地址，并可自动计数形成下一条指令地址。

IR：Instruction Register，指令寄存器，其功能是寄存以后正在执行的指令。

CU：Control Unit，控制单位（部件），为控制器的核心部件，其功能是产生微操纵命令序列。

ALU：Arithmetic Logic Unit，算术逻辑运算单位，为运算器的核心部件，其功能是进行算术、逻辑运算。

ACC：Accumulator，累加器，是运算器中既能寄存运算前的操纵数，又能寄存运算结果的寄存器。

MQ：MultiplierQuotient Register，乘商寄存器，乘法运算

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时寄存乘数、除法时寄存商的寄存器。

X：此字母没有专指的缩写含义，可以用作任一部件名，在此暗示操纵数寄存器，即运算器中工作寄存器之一，用来寄存操纵数；

MAR：Memory Address Register，存储器地址寄存器，在主存中用来寄存欲拜访的存储单位的地址。

MDR：Memory Data Register，存储器数据缓冲寄存器，在主存中用来寄存从某单位读出、或要写入某存储单位的数据。

I/O：Input/Output equipment，输入/输出设备，为输入设备和输出设备的总称，用于计算机内部和外界信息的转换与传送。

MIPS：Million Instruction Per Second，每秒执行百万条指令数，为计算机运算速度指标的一种计量单位。

9. 画出主机框图，辨别以存数指令“STA M”和加法指令“ADD M”（M均为主存地址）为例，在图中顺次标出完成该指令（包含取指令阶段）的信息流程（如→①）。假设主存容量为256M*32位，在指令字长、存储字长、机器字长相等的条件下，指出图中各寄存器的位数。

解：主机框图如P13图1.11所示。

（1）STA M指令：PC→MAR，MAR→MM，MM→MDR，MDR→IR，

OP(IR)→CU，Ad(IR)→MAR，ACC→MDR，MAR→MM，WR

（2）ADD M指令：PC→MAR，MAR→MM，MM→MDR，MDR→IR，

OP(IR)→CU，Ad(IR)→MAR，RD，MM→MDR，

MDR→X，ADD，ALU→ACC，ACC→MDR，WR

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假设主存容量256M*32位，在指令字长、存储字长、机器字长相等的条件下，ACC、X、IR、MDR寄存器均为32位，PC和MAR寄存器均为28位。

10. 指令和数据都存于存储器中，计算机如何区分它们？

解：计算机区分指令和数据有以下2种办法：

●通过不合的时间段来区分指令和数据，即在取指令阶段（或取指微法度）取出的为指令，在执行指令阶段（或相应微法度）取出的即为数据。

●通过地址来源区分，由PC提供存储单位地址的取出的是指令，由指令地址码部分提供存储单位地址的取出的是操纵数。

第2章计算机的成长及应用

1. 通常计算机的更新换代以什么为依据？

答：P22

主要以组成计算机基本电路的元器件为依据，如电子管、晶体管、集成电路等。

2. 举例说明专用计算机和通用计算机的区别。

答：依照计算机的效率、速度、价格和运行的经济性和实用性可以将计算机划分为通用计算机和专用计算机。通用计算机适应性强，但牺牲了效率、速度和经济性，而专用计算机是最有效、最经济和最快的计算机，但适应性很差。例如个人电脑和计算器。

3. 什么是摩尔定律？该定律是否永远生效？为什么？

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答：P23，否，P36

第3章系统总线

1. 什么是总线？总线传输有何特点？为了减轻总线负载，总线上的部件应具备什么特点？

答：P41.总线是一种能由多个部件分时共享的公共信息传送线路。

总线传输的特点是：某一时刻只允许有一个部件向总线发送信息，但多个部件可以同时从总线上接收相同的信息。

为了减轻总线负载，总线上的部件应通过三态驱动缓冲电路与总线连通。

2. 总线如何分类？什么是系统总线？系统总线又分为几类，它们各有何作用，是单向的，还是双向的，它们与机器字长、存储字长、存储单位有何关系？

答：依照连接部件的不合，总线可以分为片内总线、系统总线和通信总线。

系统总线是连接CPU、主存、I/O各部件之间的信息传输线。

系统总线依照传输信息不合又分为地址线、数据线和控制线。地址线是单向的，其根数越多，寻址空间越年夜，即CPU能拜访的存储单位的个数越多；数据线是双向的，其根数与存储字长相同，是机器字长的整数倍。

3. 经常使用的总线结构有几种？不合的总线结构对计算机的性能有什么影响？举例说明。

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答：略。见P5255。

4. 为什么要设置总线判优控制？罕见的集中式总线控制有几种？各有何特点？哪种方法响应时间最快？哪种方法对电路故障最敏感？

答：总线判优控制解决多个部件同时申请总线时的使用权分派问题；

罕见的集中式总线控制有三种：链式查询、计数器按时查询、自力请求；

特点：链式查询方法连线简单，易于扩充，对电路故障最敏感；计数器按时查询方法优先级设置较灵活，对故障不敏感，连线及控制过程较庞杂；自力请求方法速度最快，但硬件器件用量年夜，连线多，本钱较高。

5. 解释下列概念：总线宽度、总线带宽、总线复用、总线的主设备（或主模块）、总线的从设备（或从模块）、总线的传输周期和总线的通信控制。

答：P46。

总线宽度：通常指数据总线的根数；

总线带宽：总线的数据传输率，指单位时间内总线上传输数据的位数；

总线复用：指同一条信号线可以分时传输不合的信号。

总线的主设备（主模块）：指一次总线传输期间，拥有总线控制权的设备（模块）；

总线的从设备（从模块）：指一次总线传输期间，配合主设备

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完成数据传输的设备（模块），它只能主动接受主设备发来的命令；

总线的传输周期：指总线完成一次完整而可靠的传输所需时间；

总线的通信控制：指总线传送过程中双方的时间配合方法。6. 试比较同步通信和异步通信。

答：同步通信：指由统一时钟控制的通信，控制方法简单，灵活性差，当系统中各部件工作速度差别较年夜时，总线工作效率明显下降。适合于速度不同不年夜的场合。

异步通信：指没有统一时钟控制的通信，部件间采取应答方法进行联系，控制方法较同步庞杂，灵活性高，当系统中各部件工作速度差别较年夜时，有利于提高总线工作效率。

7. 画图说明异步通信中请求与回答有哪几种互锁关系？

答：见P6162，图3.86。

8. 为什么说半同步通信同时保存了同步通信和异步通信的特点？答：半同步通信既能像同步通信那样由统一时钟控制，又能像异步通信那样允许传输时间不一致，因此工作效率介于两者之间。

9. 别离式通讯有何特点，主要用于什么系统？

答：别离式通讯的特点是：（1）各模块欲占用总线使用权都必须提出申请；（2）在获得总线使用权后，主模块在先定的时间内向对方传送信息，采取同步方法传送，不再等待对方的回答信号；（3）各模块在准备数据的过程中都不占用总线，使总线可接受其它模块的请求；（4）总线被占用时都在做有效工作，或者通过它发送命令，

或者通过它传送数据，不存在空闲等待时间，充分利用了总线的占

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用，从而实现了总线在多个主、从模块间进行信息交叉重叠并行传

送。

别离式通讯主要用于年夜型计算机系统。

10. 为什么要设置总线标准？你知道目前流行的总线标准有哪些？什么叫plug and play？哪些总线有这一特点？

答：总线标准的设置主要解决不合厂家各类模块化产品的兼容问题；

目前流行的总线标准有：ISA、EISA、PCI等；

plug and play：即插即用，EISA、PCI等具有此功能。11. 画一个具有双向传输功能的总线逻辑图。

答：在总线的两端辨别配置三态门，就可以使总线具有双向传输功能。

12. 设数据总线上接有A、B、C、D四个寄存器，要求选用合适的74系列芯片，完成下列逻辑设计：

（1）设计一个电路，在同一时间实现D→A、D→B和D→C寄存器间的传送；

（2）设计一个电路，实现下列操纵：

T0时刻完成D→总线；

T1时刻完成总线→A；

T2时刻完成A→总线；

T3时刻完成总线→B。

解：（1）由T掀开三态门将 D寄存器中的内容送至总线bus，由

cp脉冲同时将总线上的数据打入到 A、B、C寄存器中。 T和cp

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的时间关系如图（1）所示。

图（1）

（2）三态门1受T0＋T1控制，以确保T0时刻D→总线，以及T1时刻总线→接收门1→A。三态门2受T2＋T3控制，以确保T2时刻A→总线，以及T3时刻总线→接收门2→B。T0、T1、T2、T3波形图如图（2）所示。

图(2)

13. 什么是总线的数据传输率，它与哪些因素有关？

答：总线数据传输率即总线带宽，指单位时间内总线上传输数据的位数，通经常使用每秒传输信息的字节数来衡量。它与总线宽度和总线频率有关，总线宽度越宽，频率越快，数据传输率越高。14. 设总线的时钟频率为8MHZ，一个总线周期即是一个时钟周期。如果一个总线周期中并行传送16位数据，试问总线的带宽是几多？

解：由于：f=8MHz,T=1/f=1/8M秒，一个总线周期即是一个时钟周期

所以：总线带宽=16/（1/8M） = 128Mbps

15. 在一个32位的总线系统中，总线的时钟频率为66MHZ，假设总线最短传输周期为4个时钟周期，试计算总线的最年夜数据传输率。若想提高数据传输率，可采纳什么办法？

解：总线传输周期=4*1/66M秒

总线的最年夜数据传输率=32/(4/66M)=528Mbps

若想提高数据传输率，可以提高总线时钟频率、增年夜总线宽

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度或者减少总线传输周期包含的时钟周期个数。

16. 在异步串行传送系统中，字符格式为：1个起始位、8个数据位、1个校验位、2个终止位。若要求每秒传送120个字符，试求传送的波特率和比特率。

解：一帧包含：1+8+1+2=12位

故波特率为：（1+8+1+2）*120=1440bps

比特率为：8*120=960bps

存储器

1. 解释概念：主存、辅存、Cache、RAM、SRAM、DRAM、ROM、PROM、EPROM、EEPROM、CDROM、Flash Memory。

答：主存：主存储器，用于寄存正在执行的法度和数据。CPU可以直接进行随机读写，拜访速度较高。

辅存：帮助存储器，用于寄存以后暂不执行的法度和数据，以及一些需要永久保管的信息。

Cache：高速缓冲存储器，介于CPU和主存之间，用于解决CPU 和主存之间速度不匹配问题。

RAM：半导体随机存取存储器，主要用作计算机中的主存。

SRAM：静态半导体随机存取存储器。

DRAM：静态半导体随机存取存储器。

ROM：掩膜式半导体只读存储器。由芯片制造商在制造时写入内容，以后只能读出而不克不及写入。

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PROM：可编程只读存储器，由用户根据需要确定写入内容，只

能写入一次。

EPROM：紫外线擦写可编程只读存储器。需要修改内容时，现将其全部内容擦除，然后再编程。擦除依靠紫外线使浮动栅极上的电荷泄露而实现。

EEPROM：电擦写可编程只读存储器。

CDROM：只读型光盘。

Flash Memory：闪速存储器。或称快擦型存储器。

2. 计算机中哪些部件可以用于存储信息？按速度、容量和价格/位排序说明。

答：计算机中寄存器、Cache、主存、硬盘可以用于存储信息。

按速度由高至低排序为：寄存器、Cache、主存、硬盘；

按容量由小至年夜排序为：寄存器、Cache、主存、硬盘；

按价格/位由高至低排序为：寄存器、Cache、主存、硬盘。3. 存储器的条理结构主要体现在什么处所？为什么要分这些条理？计算机如何管理这些条理？

答：存储器的条理结构主要体现在Cache主存和主存辅存这两个存储条理上。

Cache主存条理在存储系统中主要对CPU访存起加速作用，即从整体运行的效果阐发，CPU访存速度加快，接近于Cache的速度，而寻址空间和位价却接近于主存。

主存辅存条理在存储系统中主要起扩容作用，即从法度员的角

度看，他所使用的存储器其容量和位价接近于辅存，而速度接近于

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主存。

综合上述两个存储条理的作用，从整个存储系统来看，就达到了速度快、容量年夜、位价低的优化效果。

主存与CACHE之间的信息调度功能全部由硬件自动完成。而主存与辅存条理的调度目前广泛采取虚拟存储技术实现，即将主存与辅存的一部分通过软硬结合的技术组成虚拟存储器，法度员可使用这个比主存实际空间（物理地址空间）年夜很多的虚拟地址空间（逻辑地址空间）编程，当法度运行时，再由软、硬件自动配合完成虚拟地址空间与主存实际物理空间的转换。因此，这两个条理上的调度或转换操纵对法度员来说都是透明的。

4. 说明存取周期和存取时间的区别。

解：存取周期和存取时间的主要区别是：存取时间仅为完成一次操纵的时间，而存取周期不但包含操纵时间，还包含操纵后线路的恢复时间。即：

存取周期 = 存取时间 + 恢复时间

5. 什么是存储器的带宽？若存储器的数据总线宽度为32位，存取周期为200ns，则存储器的带宽是几多？

解：存储器的带宽指单位时间内从存储器进出信息的最年夜数量。

存储器带宽= 1/200ns ×32位 = 160M位/秒 = 20MB/秒 = 5M 字/秒

注意：字长32位，不是16位。（注：1ns=109s）

6. 某机字长为32位，其存储容量是64KB，按字编址它的寻址规

模是几多？若主存以字节编址，试画出主存字地址和字节地址的分

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解：存储容量是64KB 时，按字节编址的寻址规模就是64K ，

如按字编址，其寻址规模为：64K / （32/8）= 16K

主存字地址和字节地址的分派情况：如图字节地址字地址

0000H

0001H

0002H

0003H

0004H

0005H

0006H

0007H

0008H

0009H 0000H 0001H 0002H

7. 一个容量为16K×32位的存储器，其地址线和数据线的总和是几多？被选用下列不合规格的存储芯片时，各需要几多片？

1K×4位，2K×8位，4K×4位，16K×1位，4K×8位，8K×8位

解：地址线和数据线的总和 = 14 + 32 = 46根；

选择不合的芯片时，各需要的片数为：

1K×4：（16K×32） / （1K×4） = 16×8 = 128片

2K×8：（16K×32） / （2K×8） = 8×4 = 32片

4K×4：（16K×32） / （4K×4） = 4×8 = 32片

16K×1：（16K×32）/ （16K×1） = 1×32 = 32片

4K×8：（16K×32）/ （4K×8） = 4×4 = 16片

8K×8：（16K×32） / （8K×8） = 2×4 = 8片

8. 试比较静态RAM 和静态RAM 。

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答：略。（参看课件）

9. 什么叫刷新？为什么要刷新？说明刷新有几种办法。

解：刷新：对DRAM按期进行的全部重写过程；

刷新原因：因电容泄漏而引起的DRAM所存信息的衰减需要及时弥补，因此安插了按期刷新操纵；

经常使用的刷新办法有三种：集中式、分离式、异步式。

集中式：在最年夜刷新间隔时间内，集中安插一段时间进行刷新，存在CPU访存死时间。

分离式：在每个读/写周期之后拔出一个刷新周期，无CPU访存死时间。

异步式：是集中式和分离式的折衷。

10. 半导体存储器芯片的译码驱动方法有几种？

解：半导体存储器芯片的译码驱动方法有两种：线选法和重合法。

线选法：地址译码信号只选中同一个字的所有位，结构简单，费器材；

重合法：地址分行、列两部分译码，行、列译码线的交叉点即为所选单位。这种办法通过行、列译码信号的重合来选址，也称矩阵译码。可年夜年夜节省器材用量，是最经常使用的译码驱动方法。

11. 一个8K×8位的静态RAM芯片，其内部结构排列成256×256形式，存取周期为0.1μs。试问采取集中刷新、分离刷新和异步刷新三种方法的刷新间隔各为几多？

解：采取分离刷新方法刷新间隔为:2ms，其中刷新死时间为：

256×0.1μs=25.6μs

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采取分离刷新方法刷新间隔为：256×（0.1μs+×0.1μs）=51.2μs

采取异步刷新方法刷新间隔为:2ms

12. 画出用1024×4位的存储芯片组成一个容量为64K×8位的存储器逻辑框图。要求将64K分红4个页面，每个页面分16组，指出共需几多片存储芯片。

解：设采取SRAM芯片，则：

总片数 = （64K×8位） / （1024×4位）= 64×2 = 128片题意阐发：本题设计的存储器结构上分为总体、页面、组三级，因此画图时也应分三级画。首先应确定各级的容量：

页面容量 = 总容量 / 页面数= 64K×8/ 4 = 16K×8位，4片16K×8字串连成64K×8位

组容量 = 页面容量 / 组数= 16K×8位/ 16 = 1K×8位，16片1K×8位字串连成16K×8位

组内片数 = 组容量 / 片容量= 1K×8位/ 1K×4位 = 2片，两片1K×4位芯片位并联成1K×8位

存储器逻辑框图：（略）。

13. 设有一个64K×8位的RAM芯片，试问该芯片共有几多个基本单位电路（简称存储基元）？欲设计一种具有上述同样多存储基元的芯片，要求对芯片字长的选择应满足地址线和数据线的总和为最小，试确定这种芯片的地址线和数据线，并说明有几种解答。解：存储基元总数= 64K×8位 = 512K位 = 219位；

思路：如要满足地址线和数据线总和最小，应尽量把存储元安

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插在字向，因为地址位数和字数成2的幂的关系，可较好地压缩线

数。

设地址线根数为a，数据线根数为b，则片容量为：2a×b = 219；

b = 219a；

若a = 19，b = 1，总和 = 19+1 = 20；

a = 18，

b = 2，总和 = 18+2 = 20；

a = 17，

b = 4，总和 = 17+4 = 21；

a = 16，

b = 8，总和 = 16+8 = 24；

…………

由上可看出：芯片字数越少，芯片字长越长，引脚数越多。芯片字数减1、芯片位数均按2的幂变更。

结论：如果满足地址线和数据线的总和为最小，这种芯片的引脚分派计划有两种：地址线 = 19根，数据线 = 1根；或地址线= 18根，数据线 = 2根。

14. 某8位微型机地址码为18位，若使用4K×4位的RAM芯片组成模块板结构的存储器，试问：

（1）该机所允许的最年夜主存空间是几多？

（2）若每个模块板为32K×8位，共需几个模块板？

（3）每个模块板内共有几片RAM芯片？

（4）共有几多片RAM？

（5）CPU如何选择各模块板？

解：（1）该机所允许的最年夜主存空间是：218× 8位= 256K×8

位 = 256KB

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令狐采学创作 （2）模块板总数 = 256K×8 / 32K×8 = 8块

（3）板内片数 = 32K×8位 / 4K×4位 = 8×2 = 16片

（4）总片数 = 16片×8 = 128片

（5）CPU 通过最高3位地址译码输出选择模板，次高3位地址译码输出选择芯片。地址格式分派如下：

15. 设CPU 共有16根地址线，8根数据线，并用MREQ （低电平有效）作访存控制信号，W /R 作读写命令信号（高电平为读，低电平为写）。现有下列存储芯片：ROM （2K×8位，4K×4位，8K×8位），RAM （1K×4位，2K×8位，4K×8位），及74138译码器和其他门电路（门电路自定）。试从上述规格中选用合适芯片，画出CPU 和存储芯片的连接图。要求：

（1）最小4K 地址为系统法度区，4096~16383地址规模为用户法度区。

（2）指出选用的存储芯片类型及数量。

（3）详细画出片选逻辑。

解：（1）地址空间分派图：

系统法度区（ROM 共4KB ）：0000H0FFFH

用户法度区（RAM 共12KB ）：1000H3FFFH

（2）选片：ROM ：选择4K×4位芯片2片，位并联

RAM ：选择4K×8位芯片3片，字串连(RAM1地址规模为:1000H1FFFH,RAM2地址规模为2000H2FFFH, RAM3地址规模为:3000H3FFFH)

（3）各芯片二进制地址分派如下：

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CPU和存储器连接逻辑图及片选逻辑如下图(3)所示：

图（3）

16. CPU假设同上题，现有8片8K×8位的RAM芯片与CPU相连，试回答：

（1）用74138译码器画出CPU与存储芯片的连接图；

（2）写出每片RAM的地址规模；

（3）如果运行时发明不管往哪片RAM写入数据后，以A000H 为起始地址的存储芯片都有与其相同的数据，阐发故障原因。

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