数字电路实验指导书_13通信1班2班指导老师阳清

《数字逻辑电路》

电子技术实验室编

闽江学院计算机科学系

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目录

目录

实验一 数字逻辑电路实验的配套仪器设备的使用方法与练习 .................................................................. 3 实验二 TTL集成逻辑门的参数测试与使用 .................................................................................................. 6 实验三 组合逻辑电路实验分析 .................................................................................................................... 13 实验四 触发器及其应用 ................................................................................................................................ 19

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实验一 数字逻辑电路实验的配套仪器设备的使用

方法与练习

一、实验目的

1、掌握THD-1型数字电路实验箱的结构及各模块的功能。

2、熟悉数字万用表、数字示波器、函数信号发生器、稳压电源等仪器仪表的使用方法

二、实验原理

1、THD-1型数字电路实验箱的结构及各模块的功能

数字电路实验箱是对TTL门电路、COMS门电路、组合逻辑电路、时序逻辑电路等电路的功能进行验证和相关参数测量的多功能实验箱。其包括数码管及LED灯显示模块、 脉冲信号输出模块、逻辑电平输出模块，低压直流电源模块、IC（集成电路）座与管脚接口模块以及蜂鸣器继电器等组成部分。其各个模块都有一定的功能，能模拟IC的输入输出信号，使我们能更直观的认识各种集成电路。

2、数字万用表

我们使用的数字万用表是三位半液晶显示小型数字万用表。它可以测量交、直流电压和交、直流电流，电阻、三极管β值、二极管导通电压和电路短接等，由一个旋转波段开关改变测量的功能和量程。（使用方法实验课堂我将会进行讲解和演示）

3、数字示波器

数字示波器就将输入的电压、电流等电信号进行采样、存储并以图形的形式直观的显示出来的测量仪器。数字示波器将被测信号采用和量化，并将其以二进制的形式存储起来，再从存储器中取出信号的离散值。通过一定的算法将离散的信号以连续的形式在屏幕上显示出来。（具体操作我将在课堂上演示讲解） 示波器的面板介绍如下：

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屏幕菜单选择 测量辅助设置 辅助 操作 稳定 触发 Y轴 USB接口 X轴扫描 调整 屏幕 调整 输入 插座 校准 信号

4、函数信号发生器

本实验使用的是RIGOLDG1022双通道函数/任意波形发生器，其采用直接数字频率合成（DDS） 技术设计，能够产生精确、稳定、低失真的输出信号，且操作简单。其有两个输出通道CH1和CH2,可分别选择：正弦波、方波、锯齿波、脉冲波、噪声波、任意波输出。能够

调节输出波形的频率，幅度，占空比等参数。还有两个常用按键：通道选择和视图切换键。 （具体操作我将在课堂上演示讲解）

5、稳压电源

本实验使用的稳压电源型号是QJ3003SⅢ，此电源有一路固定5V/3A输出（即输出电压固定式5V，且最大带载电流是3A）两路可调输出（电压调节范围是0-30V，电流调节范围是0-3A），分别为通道Ⅰ和通道Ⅱ。两路可调输出可以独立输出，也可以进行串联或者并联输出。

三、实验设备与器件

仔细查看数字电路实验装置的结构：直流稳压电源、信号源、逻辑开关，逻辑电平显示器，元器件位置的布局及使用方法。

1、 稳压电源电源 2、双通道数字示波器 3、 函数信号发生器 4、数字万用表 6、 IN4007型二极管、及R、C元件若干 四、实验内容

正确连接数字电路实验箱、数字示波器、函数信号发生器、稳压电源的输入电源线（接

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线时要注意安全，人体切勿触碰导电金属线及插片等），电源线接口一般在仪器仪表的背部或侧面。通交流电（220V/50HZ）并按键下电源开关，使各仪器正常启动工作。 1、数字电路实验箱各模块功能的验证

(1) 将数字电路实验箱的POWER 按键置于ON状态，将DC Sourse 模块上的按钮置于

ON状态。将万用表的量程置于V=/20档，测量实验箱DC Sourse 的+5V与⊥端的输出电压，并记录结果。

(2)将DC Sourse 模块上的+5V接入到 Pulse Soures模块的+5V插孔上，同时也记录到实验箱第三个数码管旁边的+5V插孔上。将Pulse Soures模块的H（红色）指示灯插孔连接到数码管下边的A孔，按下Single pulse 按钮，记录数码管的变化情况。

2、数字示波器的使用

将数字示波器的接地端和探针分别与数字电路试验箱上Pulse Soures模块的⊥端和Pulse Output 端相连。测量脉冲输出的频率和占空比，并记录实验结果，改变Fre-Rang按钮的位置，观察脉冲指示灯的状态再次记录实验结果。

3、用函数信号发生器的通道2输出一个脉冲波，频率为你所在的编组号乘以1000HZ(例如：假设你是第5组的成员，那你要输出的脉冲频率是5*1000HZ=5000HZ 即5KHZ)。记录你的调节步骤和方法。写入实验报告。

4、用数字万用表测量二级管的导通压降。用数字万用表测量数字电路实验箱内左下角100K可变电阻器的以下几组电阻值：1.2K欧、15K欧、57K欧，并记录实验步骤和实验读数。

5、思考稳压电源两组可调输出进行串联输出和并联输出的电压电流与独立输出时有什么不同，并加以验证

五、实验报告

1、对数字电路实验箱的各功能模块进行说明。 2、总结各仪器仪表的主要功能和使用方法步骤。

六、实验预习要求

1、了解稳压电源、数字示波器、函数信号发生器、数字万用表的基本功能。 2、查阅各仪器仪表的操作说明，会一些简单操作。

3、思考数字电路实验箱应该完成哪些基本功能。

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1、记录、整理实验结果，并对结果进行分析。

2、画出实测的电压传输特性曲线，并从中读出各有关参数值。

六、集成电路芯片简介

数字电路实验中所用到的集成芯片都是双列直插式的，其引脚排列规则如图2－1所示。识别方法是：正对集成电路型号（如74LS20）或看标记（左边的缺口或小圆点标记），从左下角开始按逆时针方向以1，2，3，?依次排列到最后一脚（在左上角）。在标准形TTL集成电路中，电源端VCC一般排在左上端，接地端GND一般排在右下端。如74LS20为14脚芯片，14脚为VCC，7脚为GND。若集成芯片引脚上的功能标号为NC，则表示该引脚为空脚，与内部电路不连接。

七、TTL集成电路使用规则

1、接插集成块时，要认清定位标记，不得插反。

2、电源电压使用范围为＋4.5V～＋5.5V之间，实验中要求使用Vcc＝＋5V。电源极性绝对不允许接错。

3、闲置输入端处理方法

(1) 悬空，相当于正逻辑“1”，对于一般小规模集成电路的数据输入端，实验时允许悬空处理。但易受外界干扰，导致电路的逻辑功能不正常。因此，对于接有长线的输入端，中规模以上的集成电路和使用集成电路较多的复杂电路，所有控制输入端必须按逻辑要求接入电路，不允许悬空。

(2) 直接接电源电压VCC（也可以串入一只1～10KΩ的固定电阻）或接至某一固定电压(＋2.4≤V≤4.5V)的电源上， 或与输入端为接地的多余与非门的输出端相接。 (3) 若前级驱动能力允许，可以与使用的输入端并联。

4、输入端通过电阻接地，电阻值的大小将直接影响电路所处的状态。当R≤680Ω时，输入端相当于逻辑“0”；当R≥4.7 KΩ时，输入端相当于逻辑“1”。对于不同系列的器件，要求的阻值不同。

5、输出端不允许并联使用（集电极开路门(OC)和三态输出门电路(3S)除外）。否则不仅会使电路逻辑功能混乱，并会导致器件损坏。

6、输出端不允许直接接地或直接接＋5V电源，否则将损坏器件，有时为了使后级电路获得较高的输出电平，允许输出端通过电阻R接至Vcc，一般取R＝3～5.1 KΩ。

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实验三 组合逻辑电路实验分析

一、实验目的

1. 掌握组合逻辑电路的分析方法与测试方法 2. 了解组合电路的冒险现象及其消除方法 二、实验原理

1. 组合电路是最常见的逻辑电路，可以用一些常用的门电路来组合成具有其他功能的门电路。例如，根据与门的逻辑表达式Z?A?B?A?B得知，可以用两个与非门就可组合成一个与门。还可以组合成更复杂的逻辑关系。

2. 组合电路的分析是根据所给的逻辑电路，写出其输入与输出之间的逻辑函数表达式或真值表，从而确定该电路的逻辑功能。

3. 组合电路设计过程是在理想情况下进行的，即假设一切器件均没有延迟效应，但实际上并非如此，信号通过任何导线或器件都需要一段响应时间，由于制造工艺上的原因，各器件延迟时间的离散性很大。这就有可能在一个组合电路中，在输入信号发生变化时，有可能产生错误的输出。这种输出出现瞬时错误的现象称为组合电路的冒险现象（简称险象）。本实验仅对逻辑冒险中的静态0型与1型冒险进行研究。 如附图3-1所示的电路。

(a) 简单组合电路 （b） 输入A变化时的波形图

附图3-1 0型静态险象

其输出函数Z?A?A，在电路达到稳定时，即静态时，输出P总是1。然而在输入A变化时(动态时)从附图3-1(b)可见，在输出Z的某些瞬间会出现0，即当A经历1→0的变化时，Z出现窄脉冲，即电路存在静态0型现象。

同理，在附图3-2所示的电路，Z?AA，存在有静态1型险象。

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(a) （b）

附图3-2 1型静态险象

进一步研究得知，对于任何复杂的按“与或”或“或与”函数式构成的组合电路中，只要能成为A?A或AA的形式，必须存在险像。为了消除此险像，可以增加校正项，前者的校正项为被赋值各变量的“乘积项”，后者的校正项为被赋值各变量的“和项”。

还可以用卡诺图的方法来判断组合电路是否存在静态险像，以及找出校正项来消除静态险像。

三、实验设备与器件

1. +5V直流电源 3. 连续脉冲源

2.双踪示波器 4.逻辑电平开关

5. 0-1指示器

6. 74LS00 74LS08 74LS32 74LS86 四、实验内容

组合逻辑电路的分析是根据所给的逻辑电路，按逻辑门的连接方式，逐一写出相应的逻辑表达式，然后写出输出函数的表达式，列出真值表，并画出卡诺图判断能否简化。

(一)分析测试半加器的逻辑功能 1. 写出附图3-3的逻辑表达式

附图3-3 由与非门组合成的半加器电路

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2.根据表达式列出真值表，并画出卡诺图判断能否简化 A 0 0 1 1

B 0 1 0 1 Z1 Z2 Z3 S C

3.根据附图3-3，在实验箱选定两个14P插座，插好两片74LS00，并接好连线，A、B两输入接至逻辑开关的输出插口。S、C分别接至逻辑电平显示输入插口。按下表的要求进行逻辑状态的测试，并将结果填入表中，同时与上面真值表进行比较，两者是否一致。

A 0 0 1 1

(二)分析、测试用异或门74LS86和与非门74LS00组成的半加器逻辑电路，根据半加器的逻辑表达式可知，半加的和S是A、B的异或，而进位C是A、B的相与，故半加器可用一个集成异或门和二个与非门组成，如附图3-4所示。测试方法同(一)3项，将测试结果填入自拟表格中，并验证逻辑功能。

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B 0 1 0 1 S C

附图3-4 半加器电路

(三)分析、测试全加器的逻辑电路 1. 写出附图3-5电路的逻辑表达式

附图3-5 由与非门组合成的全加器电路

2. 列出真值表 Ai 0 0 1 1 0 0 1 1 16

Bi 0 1 0 1 0 1 0 1 Ci-1 0 0 0 0 1 1 1 1 S X1 X2 X3 Si Ci

3.根据真值表画出逻辑函数Si、Ci卡诺图

4. 按附图3-5的要求，选择与非门并接线，进行测试，将测试结果填入下表，并与上面真值表进行比较逻辑功能是否一致。 Ai 0 0 1 1 0 0 1 1

(四)分析、测试用异或门、或非门和非门组成的全加器逻辑电路 根据全加器的逻辑表达式

全加和 Si=Ai⊕Bi⊕Ci-1

进 位 Ci=(Ai⊕Bi)·Ci-1+ Ai·Bi

可知一位全加器可以用两个半加器和两个与门一个或门组成。(使用74LS86 74LS08 74LS32三种芯片)

1.画出用上述门电路实现的全加器逻辑电路。 2.按所画的原理图，选择器件，并在实验箱上接线。

3.进行逻辑功能测试，将测试结果填入自拟表格中，判断测试是否正确。 (五)观察冒险现象（这一个内容选做，有能力的同学最后做下实验看看现象）

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Bi 0 1 0 1 0 1 0 1 Ci-1 0 0 0 0 1 1 1 1 Si Ci

按附图3-6接线，当B=1，C=1时，A输入矩形波(f=1MHz以上)，用示波器观察Z输出波形。

然后，试用添加校正项的方法消除险象。

附图3-6

五、实验预习要求

1.复习组合逻辑电路的分析方法。

2.复习用与非门和异或门构成半加器、全加器的工作原理。 3.复习组合电路险象的种类，产生原因，如何防止？ 4.根据实验任务要求，设计好必要的线路。 六、实验报告

1.整理实验数据、图表，并对实验结果进行分析讨论。 2.总结组合电路的分析与测试方法。 3.对险象进行讨论。

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实验四 触发器及其应用

一、实验目的

1、掌握基本RS、JK、D和T触发器的逻辑功能 2、掌握集成触发器的逻辑功能及使用方法 3、熟悉触发器之间相互转换的方法 二、实验原理

触发器具有两个稳定状态，用以表示逻辑状态“1”和“0”，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态，它是一个具有记忆功能的二进制信息存贮器件，是构成各种时序电路的最基本逻辑单元。 1、基本RS触发器

图8－1为由两个与非门交叉耦合构成的基本RS触发器，它是无时钟控制低电平直接触发的触发器。基本RS触发器具有置“0”、置“1”和“保持”三种功能。通常称S为置“1”端，因为S＝0（R＝1）时触发器被置“1”；R为置“0”端，因为R＝0（S＝1）时触发器被置“0”，当S＝R＝1时状态保持；S＝R＝0时，触发器状态不定，应避免此种情况发生，表4－1为基本RS触发器的功能表。

基本RS触发器。也可以用两个“或非门”组成，此时为高电平触发有效。 表4－1 输 入 输 出 Qn+1 1 0 Qn φ S 0 1 1 0 2、JK触发器

R 1 0 1 0 Qn+1 0 1 Qn φ 在输入信号为双端的情况下，JK触发器是功能完善、使用灵活和通用性较强的一种触发器。本实验采用74LS76双JK触发器，是下降边沿触发的边沿触发器。引脚功能及逻辑符号如图4－2所示。

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JK触发器的状态方程为

Qn+1 ＝JQn＋KQn

J和K是数据输入端，是触发器状态更新的依据，若J、K有两个或两个以上输入端时，组成“与”的关系。Q与Q 为两个互补输出端。通常把 Q＝0、Q＝1的状态定为触发器“0”状态；而把Q＝1，

Q＝0定为“1”状态。

图4－2 74LS76双JK触发器引脚排列及逻辑符号

下降沿触发JK触发器的功能如表4－2 表4－2

输 入 输 出 J × × × 0 1 0 1 × K × × × 0 0 1 1 × Qn+1 1 0 φ Qn 1 0 SD 0 1 0 1 1 1 1 1 RD 1 0 0 1 1 1 1 1 CP × × × ↓ ↓ ↓ ↓ ↑ Qn+1 0 1 φ Qn 0 1 Qn Qn Qn Qn 注：×— 任意态 ↓— 高到低电平跳变 ↑— 低到高电平跳变

Qn（Qn ）— 现态 Qn+1（Qn+1 ）— 次态 φ— 不定态

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JK触发器常被用作缓冲存储器，移位寄存器和计数器。 3、D触发器

在输入信号为单端的情况下，D触发器用起来最为方便，其状态方程为 Q

n+1

＝D，其输出状态的更新发生在CP脉冲的上升沿，故又称为上升沿触发的边沿触发器，触发器的

n

状态只取决于时钟到来前D端的状态，D触发器的应用很广，可用作数字信号的寄存，移位寄存，分频和波形发生等。有很多种型号可供各种用途的需要而选用。如双D 74LS74、四D 74LS175、六D 74LS174等。

图4－3 为双D 74LS74的引脚排列及逻辑符号。功能如表4－3。

图4－3 74LS74引脚排列及逻辑符号

表4－3 表4－4

输 入 输 出 D × × × 1 0 × Qn＋1输 入 输出 T × × 0 1 Qn1 ＋SD 0 1 0 1 1 1 RD 1 0 0 1 1 1 CP × × × ↑ ↑ ↓ Qn＋1 0 1 φ 0 1

SD 0 1 1 1 RD CP 1 0 1 1 × × ↓ ↓ 1 0 φ 1 0 Qn 1 0 Qn Qn Qn 4、触发器之间的相互转换

在集成触发器的产品中，每一种触发器都有自己固定的逻辑功能。但可以利用转换的方法获得具有其它功能的触发器。例如将JK触发器的J、k两端连在一起，并认它为T端，就得到所需的T触发器。如图4－4(a)所示，其状态方程为： Qn+1 ＝TQn ＋TQn

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(a) T触发器 (b) T'触发器

图4－4 JK触发器转换为T、T'触发器

T触发器的功能如表4－4。

由功能表可见，当T＝0时，时钟脉冲作用后，其状态保持不变；当T＝1时，时钟脉冲作用后，触发器状态翻转。所以，若将T触发器的T端置“1”，如图4－4(b)所示，即得T'触发器。在T'触发器的CP端每来一个CP脉冲信号，触发器的状态就翻转一次，故称之为反转触发器，广泛用于计数电路中。

同样，若将D触发器Q 端与D端相连，便转换成T'触发器。如图4－5所示。 JK触发器也可转换为D触发器，如图4－6。

图4－5 D转成T' 图4－6 JK转成D 5、CMOS触发器

（1）CMOS边沿型D触发器

CC4013是由CMOS传输门构成的边沿型D触发器。它是上升沿触发的双D触 发器，表4－5为其功能表，图4－7为引脚排列。

表4－5

输 入 S 1 0 1 0 0 R 0 1 1 0 0 CP × × × ↑ ↑ D × × × 1 0 输 出 Qn1 ＋1 0 φ 1 0 22

0

0 ↓ × Qn

图4－7 双上升沿D触发器 （2）CMOS边沿型JK触发器

CC4027是由CMOS传输门构成的边沿型JK触发器，它是上升沿触发的双JK 触发器，表4－6为其功能表，图4－8为引脚排列。

表4－6

输 入 S 1 0 1 0 0 0 0 0 R 0 1 1 0 0 0 0 0 CP × × × ↑ ↑ ↑ ↑ ↓ J × × × 0 1 0 1 × K × × × 0 0 1 1 × 输 出 Qn1 ＋ 图4－8 双上升沿J－K触发器

1 0 φ Qn 1 0 Qn Qn CMOS触发器的直接置位、复位输入端S和R是高电平有效，当S＝1（或R＝1）时，触发器将不受其它输入端所处状态的影响，使触发器直接接置1（或置0）。但直接置位、复位输入端S和R必须遵守RS＝0的约束条件。CMOS触发器在按逻辑功能工作时，S和R必须均置0。

三、实验设备与器件

1、＋5V直流电源 2、双踪示波器

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3、连续脉冲源 4、单次脉冲源 5、逻辑电平开关 6、逻辑电平显示器 7、74LS76 74LS00 74LS74 四、实验内容

1、测试基本RS触发器的逻辑功能

按图4－1，用两个与非门组成基本RS触发器，输入端R、S接逻辑开关的输出插口，输出端 Q、

Q接逻辑电平显示输入插口，按表4－7要求测试，记录之。

表4－7 R 1 S 1→0 0→1 Q Q 1→0 1 0→1 0

0 2、测试双JK触发器74LS76逻辑功能 (1) 测试RD 、SD的复位、置位功能

任取一只JK触发器，RD、SD、J、K端接逻辑开关输出插口，CP端接单次脉冲源，Q、Q端接至逻辑电平显示输入插口。要求改变RD，SD（J、K、CP处于任意状态），并在RD＝0（SD＝1）或SD＝0（RD＝1）作用期间任意改变J、K及CP的状态，观察Q、Q状态。自拟表格并记录之。 (2) 测试JK触发器的逻辑功能

按表4－8的要求改变J、K、CP端状态，观察Q、Q状态变化，观察触发器状态更新是否发生在CP脉冲的下降沿（即CP由1→0），记录之。

(3) 将JK触发器的J、K端连在一起，构成T触发器。 在CP端输入1HZ连续脉冲，观察Q端的变化。

在CP端输入1KHZ连续脉冲，用双踪示波器观察CP、Q、Q端波形，注意相位关系，描绘之。

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表4－8

J K CP 0→1 1→0 0→1 1→0 0→1 1→0 0→1 1→0 Qn1 ＋Qn＝0 Qn＝1 0 0 0 1 1 0 1 1

3、测试双D触发器的逻辑功能

(1) 用74LS76JK触发器及与非门构成D触发器，如图：

图 4-9

(2) 测试D触发器的逻辑功能

按表4－9要求进行测试，并观察触发器状态更新是否发生在CP脉冲的上升沿（即由0→1），记录之。

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表4－9

D CP 0→1 1→0 0→1 1→0 Qn1 ＋Qn＝0 Qn＝1 0 1

(3) 将D触发器的Q端与D端相连接，构成T'触发器。 测试方法同实验内容2、3），记录之。

4、双相时钟脉冲电路

用JK触发器及与非门构成的双相时钟脉冲电路如图4－9所示，此电路是用来将时钟脉冲CP转换成两相时钟脉冲CPA及CPB，其频率相同、相位不同。

分析电路工作原理，并按图4－9接线，用双踪示波器同时观察CP、CPA；CP、CPB及CPA、CPB

波形，并描绘之。

图4－10 双相时钟脉冲电路

5、乒乓球练习电路

电路功能要求：模拟二名动运员在练球时，乒乓球能往返运转。

提示：采用双D触发器74LS74设计实验线路，两个CP端触发脉冲分别由两 名运动员操作，两触发器的输出状态用逻辑电平显示器显示。 五、实验预习要求 1、复习有关触发器内容 2、列出各触发器功能测试表格

3、按实验内容4、5的要求设计线路，拟定实验方案。 六、实验报告

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1、列表整理各类触发器的逻辑功能。

2、总结观察到的波形，说明触发器的触发方式。 3、体会触发器的应用。

4、利用普通的机械开关组成的数据开关所产生的信号是否可作为触发器 的时钟脉冲信号？为什么？是否可以用作触发器的其它输入端的信号？又是为什么？

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本文来源：https://www.bwwdw.com/article/alw.html