洛阳师范学院2011-2012-1《计算机组成原理》试卷A

洛 阳 师 范 学 院 试 卷

院（系） 班 级 12计科班 姓 名 杨重路 准 考 证 号

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本卷由12级计科班杨重路整理

洛阳师范学院2011—2012学年第一学期期末考试

网络工程、软件工程、计算科学与技术 专业 2010、2011专升本 级 计算机组成原理 试卷（A卷）

题号 得分 得分 评卷人

一 二 三 四 五 总分 本卷由12级计科班杨重路整理

一、单项选择题（每小题1分，共10分）

1.运算器的主要功能是（ ）。 A）算术运算

B）逻辑运算

C）函数运算

D）算术运算与逻辑运算

2.冯·诺依曼机工作方式的基本特点是（ ）。 A）多指令流单数据流

B）按地址访问并顺序执行指令 D）存储器按内容选择地址

C）堆栈操作

3.定点16位字长的字，采用2的补码形式表示时,一个字所能表示的整数范围是（ ）。 A）-215 ~（215-1）

B）-（215-1）~（215-1） D）-215 ~ 215

C）-(215+1）~ 215

4.相联存储器进行寻址的方式是（ ）。 A）地址方式

B）堆栈方式

D）地址方式与堆栈方式

C）内容指定方式

5.在下列因素中，与Cache的命中率无关的是（ ）。 A）Cache块的大小 C）主存的存取时间

B）Cache的容量 D）Cache的组织方式

6.若浮点数用补码表示，则判断运算结果是否为规格化数的方法是（ ）。 A）阶符与数符相同为规格化数 B）阶符与数符相异为规格化数

C）数符与尾数小数点后第一位数字不同为规格化数 D）数符与尾数小数点后第一位数字相同为规格化数

7.四片74181ALU和一片74182CLA器件相配合，具有如下进位传递功能（ ）。 A）行波进位

B）组内先行进位，组间串行进位 D）组内先行进位，组间先行进位

C）组内串行进位，组间先行进位

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8.进行补码一位乘法时，被乘数和乘数均用补码表示，运算时（ ）。

A. 首先在乘数最末位yn后增设附加位yn+1，且初始yn+1＝0，再依照ynyn+1的值确定下面的运算 B. 首先在乘数最末位yn后增设附加位yn+1，且初始yn+1＝1，再依照ynyn+1的值确定下面的运算

C. 首先观察乘数符号位，然后决定乘数最末位yn后附加位yn+1的值，再依照ynyn+1的值确定下面的运算 D. 不应在乘数最末位yn后增设附加位yn+1，而应直接观察乘数的末两位yn－1yn确定下面的运算 9.某计算机字长16位，其存储容量为4MB，若按字编址，它的寻址范围是（ ）。 A）2MW C）4MW

B）4MB D）2MB

10.Cache的地址映象中，若主存中的任一块均可映射到Cache内的任一块的位置上，称作（ ）。 A）直接映象 C）组相联映象 得分 评卷人

B）全相联映象 D）多路组相联映像

二、判断题（每小题1分，共10分）

（ ）1.决定计算机运算精度的主要技术指标是计算机的字长。 （ ）2.当浮点数阶码小于最小阶码时，称为下溢，此时按机器零处理。

（ ）3.存取周期是指存储器进行连续两次独立的存储器操作所需的最小间隔时间，它的时间小于存取时间。 （ ）4.同一体系结构的计算机，它们的组成有相当大的差别。 （ ）5.缩短存取周期，可提高存储器带宽。 （ ）6.分散式刷新没有死区，能提高系统的速度。

（ ）7.汉明码是一种能发现错误，并具有一位纠错能力的编码。 （ ）8.低位多体交叉存储器是一种并行存储器，能够扩大存储器的容量。 （ ）9.原码的加减交替法中，第一次上商用来判断是否溢出。

（ ）10.当浮点机和定点机中的数的位数相同时，浮点数的表示范围比定点数的大得多。 得分 评卷人

三、简答题 （每小题5分，共20分）

1.说明高级语言、汇编语言和机器语言的差别及联系。

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2.存储器层次结构主要体现在什么地方？为什么要分这些层次，计算机如何管理这些层次？

3.半导体存储芯片的译码驱动方式有哪几种？各自的优缺点是什么？

4.Cache制作在CPU芯片内有什么好处？将指令Cache和数据Cache分开又有什么好处？

得分 评卷人

四、计算题 （每小题10分，共30分）

1.设机器数字长为8位（含1位符号位），用补码运算规则计算下列各题，并用变形补码判断溢出。 （1）A?1917，B??，求A-B； 32128（2）A=100，B=30，求A+B

2.假设阶码取3位，尾数取6位（均不包含符号位），要求阶码和尾数均用补码表示，计算： （0.1011×2101）+(-0.1001×2100)

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3.将十进制数-0.75转换成IEEE754的短实数浮点格式。

得分 评卷人

五、应用题(每小题10分，共30分)

1.画出主机框图，以取数指令“LDA M”（M为主存地址）为例，依据所画图按序写出完成该指令（包括取指阶段）的

①??）。假设主存容量为64K×8位，在指令字长、存储字长、机器字长相等的条件下，指出图中信息流程（如??各寄存器的位数。

2.设CPU共有16根地址线，8根数据线，并用MREQ（低电平有效）作访存控制信号，R/W作读写命令信号（高电平为读，低电平为写）。现有8片8K×8位的RAM芯片与CPU相连。 （1）用74138译码器画出CPU与存储芯片的连接图。 （2）写出每片RAM的地址范围。

（3）根据（1）的连接图，若出现地址线A13与CPU断线，并搭接到高电平上，将出现什么后果？

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3．设主存容量为1MB，采用直接映射方式，的Cache容量为16KB，块长为4个字，每字32位。试问主存地址为ABCDEH的存储单元在Cache中的什么位置？

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本文来源：https://www.bwwdw.com/article/6d02.html