基于DSP的车载雷达测速系统设计
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经典
《自动化技术与应用》2006年第25卷第7期
计算机应用
Computer applications
基于DSP的车载雷达测速系统设计
唐 伟,孙志芳,陈 全
(长江大学计算机科学学院,湖北 荆州 434023)
摘 要:针对运行中火车测速,运用多普勒效应,采用DSP设计雷达测速系统,并阐述了其基本设计思想与工作原理。给出系统
硬件、软件设计结构和原理图,改善了原有光电测速精度,提高了系统工作稳定性和可靠性,经实验证明DSP采集板工作稳定,测速效果好。
关键词:DSP; 雷达测速; 多普勒效应
中图分类号:TJ310.35 文献标识码:B 文章编号:1003-7241(2006)07-0020-03
On Board DSP-Based Radar Speed Measurement System
TANG Wei, SUN Zhi-fang, CHEN Quan
(Dept.of computer Science,Yangtze University,Jingzhou 434023,China)
Abstract: This paper presents a DSP-based train speed measurement by using Doppler radar. The structure of the system is
introduced.The hardware and software are also discussed.
Key words: DSP; rader speed measurement; doppler principle
1 引言
目前,我国列车机车的运行速度装置主要都是采用光电式测速传感器来测速。它的低速测量精度高。但测速150公里以上时,存在着精度问题。随着我国多次提速的发展,对于原来使用的光电式测速传感器进行速度采集的测速装置系统提出了新的要求,参照国外的高速列车测速装置的发展情况,我们对目前专为我国铁路市场开发的S3雷达测速传感器进行全面的测试。由于现在DSP已经广泛应用在通信、计算机、工业控制领域[3],使用DSP为处理核的雷达测速系统对目前车载雷达测速系统主要以光电测速方式进行测量的现状具有重要的意义。
变化采用Chirp-Z变换处理,使用DSP的内核实时处理反映当前速度值变化,每0.04秒输出一个脉冲形式的速度信号,测量分辨率达到0.5Km/H,低速段误差范围控制在5%,高速段误差范围控制在1%。
基本设计概念和处理流程:
A、基本设计概念:A/D按照50KHz的采样频率采集多普勒频移信号,接口FPGA把这些采样值缓存在双口RAM中,每缓存2K×16bit的雷达采样数据向DSP发送Int7中断,DSP的中断处理程序把这一帧的值滤波后进行FFT变换,再取频谱的最大值的下标,再把下标转换成频率值,再由公式转换出当前速度值。
B、系统框图:
2 设计思想和系统框图
雷达测速仪是应用多普勒效应原理,即移动物体对所接收的电磁波有频移的效应,由接收到的反射波频移量计算得出被测物体的运动速度。它集计算机软件技术,通信技术,测控检测技术为一体,对微量信号
收稿日期:2006-02-24图1 系统框图
经典
计算机应用
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《自动化技术与应用》2006年第25卷第7期
图1中,各方框表示系统组成的各个单元功能模块;图中实线部分表示各部分数据或信号连接,虚线部分为电源供应部分。
4.1应用层软件分为5个模块
1、信号采集模块:DSP每次中断,读取从FPGA中按DMA方式发送过来的帧数据。
2、滤波模块:直接使用FIR低通滤波,通过加窗函数实现。
3、Chirp-Z变换模块:按照Chirp-Z变换进行频谱分析,计算出临时fd附近的频谱。这一步先在Matlab中仿真并直接产生代码。
4、瞬时速度模块:按照Chirp-Z变换分析的频谱,求出频谱的最大值对应的下标,按照下标求出频率,按照频率求出速度。
5、输出模块:信号通过RS485输出,建立DSP和主机板的通信协议。
3 系统硬件设计和功能
DSP是整个设备的核心部分,包括运算器和控制器,而TMS320C6701还将外围电路部件的定时计数器、中断控制器、DMA控制器、多功能串口等集成的DSP中。其中雷达探头将速度变换成微弱的正弦波信号。SDRAM、SSRAM作为同步动态数据存储器,是系统数据存储器之一。FLASH用作程序存储器,存放系统程序。时钟Y1是DSP外部的时钟,为DSP提供时钟。时钟Y2作为FPGA外部时钟,为FPGA提供时钟。A/D转换将模拟的信号转换成数字量的信号输出到FPGA。
数据传输:系统可用三种方式作数据的输出。分别是脉冲方式、I/O串口方式和McBSP串口方式。输出的数据是检测到的速度值。
FPGA:实现三部分的功能。第一部分,对A/D进行控制;第二部分,对A/D转换的数据进行采集,并缓存在FPGA内存中,由DSP响应中断再发送给DSP处理;第三部分,接受DSP的控制信号。
信号放大:对微弱的电信号进行放大,系统是用有源器件对微弱的速度电信号放大到系统所需的电信号。
电源:系统电源部分由12V直流电输入。经过变换为系统分别提供8V、±5V、3.3V、1.8V和1.5V直流电输出。
电路设计中为了提高系统运行的运行可靠性,对各部分电路作了分别接地和敷铜等多种方法处理。
4.2 程序工作流程
信号首先由FPGA进行A/D转换,采样频率值可选,由DSP决定。采集过程当缓冲区数据满时,FPGA产生中断信号,CPU响应中断,总线控制权交给DMA开始读取块数据,同时对接收数据进行去直流分量,分实部、虚部为数据分配存储空间。注意在程序实现时将数据在经过缓冲区时进行分帧处理。
滤波模块完成的工作:处理后的信号含有一定的干扰信号,使用软件滤波将频率范围外的高频、工频干扰消除。首先用Matlab模拟窗函数系数,使用循环卷积对输入信号进行FIR滤波。
Chirp-Z变换模块完成的工作:对输入信号经Chirp-Z变换求出临时fd附近频谱,根据频谱分析理论和在仿真软件Matlab下仿真知,该算法能估计出信号的主频,而且抗干扰能力强,实现简单。此变换是整个系统软件中的核心。
瞬时速度模块分为三个部分实现:频谱最大值及下标计算、起始角度更新计算、速度计算。
输出模块:测得的速度信号值经RS485接口输出。
4 系统软件设计和功能
软件系统采用了流行的面向对象的设计思想和模块化的设计流程,并且采用了分层设计的原则,充分利用TI公司提供的相应数字信号处理库进行设计件框架图如下:
[1]
,其软
4.3 DSP系统引导设计和FLASH烧写
TMS320C6701在进行引导工作中,首先进行DSP上电复位,程序段存储在外部Flash,DSP自动将位于地址空间CE1(0x1400000~0x1430000)开头的64KB代码通过EDMA方式传输到DSP的EMIF(本设计为SBSRAM)的地址空间0x400000处。ROM中的程序以little endian格式存储。数据传输采用默认时序,
图2 系统软件框架图
SST39VF400的数据宽度为16bit,由EMIF自动将两次
(下转第32页)
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《自动化技术与应用》2006年第25卷第7期
工业控制与应用
Industry Control and applications
护人员的劳动强度。[3] Gary Entsminger 精通Visual Basic 3编程[M].北京: 清华大学出版社, 1995.4.
参考文献
[1] HSIANG CHENG HC6000电力监控仪使用说明书[Z]. 内部资料 1998.7.
[2] ADVANTECH ADAM5000 User’s Manual[Z].研华公司, 1998.10.
[4] 张维青.准北电网能量管理系统(EMS)的应用[J].自动化技术与应用,2004,23(8):75-77.
作者简介:裴福昌(1960-),男,高工,长期从事工业电气自动化控制的设计调试工作。
(上接第21页)
读入数据合并为32bit数据。这整个过程为程序的自引导。由于我们代码长度大于64KB,还需程序来引导多余长度代码的转换工作。在命令文件中,设计将.cinit装载到外部ROM中,而运行地址在片内数据区。用代码完成.cinit从外部ROM中搬到片内数据区,使其能
在C编程环境下进行正确的初始化工作。
烧写过程采用在线编程的方式对FLASH存储器进行操作,通过JTAG仿真器运行程序,将可引导代码在线烧录到FLASH中,然后通过boot.asm实现系统的自引导,让应用程序在DSP中跑起来[2]。其流程可分为DSP初始化,FLASH擦除,FLASH编程,校验,数据读入及编程。
5 结论
火车载雷达测速系统的研制于2005年年底完成,室内测试结果显示高速阶段测量误差符合标准,性能稳定,具有灵活性强、易于升级换代,它与光电测速仪相结合可以很好地满足车载测速。
参考文献:
图3 Chirp-Z变换算法逻辑
[1] TMS320C6000 Chip Support Library API ReferenceGuide. Texas Instruments[Z], August 2004.
[2] TMS320C6000 EMIF to External FLASH Memory[Z].Texas Instruments,1999.
[3] 高瑞昌,孙昌国.DSP在测速中的应用[J].自动化技术与应用,2004,23(3):71-73.
作者简介:唐伟(1967-),男,工程师,在职硕士,研究方向:计算机检测与控制。
图4 TMS320C6701烧写流程
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