《数字电子技术基础》复习题（带答案）

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《数字电子技术基础》

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数字电子技术基础复习试卷一

一、选择题（从每小题的四个备选答案中，选出一个正确答案，并将其号码填在括号内，每小题2分，共

20分）

1.将十进制数（18）10转换成八进制数是 [ ] ① 20 ② 22 ③ 21 ④ 23 2. 三变量函数

F?A,B,C??A?BC的最小项表示中不含下列哪项 [ ]

① m2 ② m5 ③ m3 ④ m7

3.一片64k×8存储容量的只读存储器（ROM），有 [ ] ①64条地址线和8条数据线 ②64条地址线和16条数据线 ③16条地址线和8条数据线 ④16条地址线和16条数据线 4.下列关于TTL与非门的输出电阻描述中，正确的是 [ ] ①门开态时输出电阻比关态时大 ②两种状态都是无穷大输出电阻 ③门关态时输出电阻比开态时大 ④两种状态都没有输出电阻 5.以下各种ADC中，转换速度最慢的是 [ ] ① 并联比较型 ② 逐次逼进型 ③ 双积分型 ④ 以上各型速度相同 6. 关于PAL器件与或阵列说法正确的是 [ ] ① 只有与阵列可编程 ② 都是可编程的 ③ 只有或阵列可编程 ④ 都是不可编程的 7. 当三态门输出高阻状态时，输出电阻为 [ ] ① 无穷大 ② 约100欧姆 ③ 无穷小 ④ 约10欧姆

8.通常DAC中的输出端运算放大器作用是 [ ] ① 倒相 ② 放大 ③ 积分 ④ 求和

9. 16个触发器构成计数器，该计数器可能的最大计数模值是 [ ] ① 16 ② 32 ③ 16 ④ 2

10.一个64选1的数据选择器有（ ）个选择控制信号输入端。 [ ]

2

16

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① 6 ② 16 ③ 32 ④ 64

二、填空题（把正确的内容填在题后的括号内。每空1分，共15分。）

1．已知一个四变量的逻辑函数的标准最小项表示为

F?a,b,c,d???m?0,2,3,4,6,8,9,11,13?，那么用最小项标准表

示F?? ，以及F? ，使用最大项标准表示

F? ，以及F? 。

2．具有典型实用意义的可编程逻辑器件包括 ， ， ， 。 3．为了构成4K×16bit的RAM，需要 块1K×8bit的RAM，地址线的 高 位作为地址译码的输入，地址译码使用的是 译码器。

4．在AD的量化中，最小量化单位为Δ，如果使用四舍五入法，最大量化误差为 Δ，如果使用舍去小数法，最大量化误差为 Δ。

5．如果用J-K触发器来实现T触发器功能，则T,J,K三者关系为 ；如果要用J-K触发器来实现D触发器功能，则D,J,K三者关系为 。 三、 简答题（每小题5分，共10分）

1．用基本公式和定理证明下列等式：

?AB?C?B?ABC?ABC?ABC

2．给出J-K触发器的特征方程，状态转移真值表，状态转移图。 四、 分析题（25分）

1．8选1数据选择器CC4512的逻辑功能如表4.1所示。试写出图4.1所示电路输出端F的最简与或形式的表达式。（9分）

表4.1 CC4512功能表 IS 0 0 0 0 0 0 0 0 0 INH 0 0 0 0 0 0 0 0 0 A2 0 0 0 0 1 1 1 1 × A1 0 0 1 1 0 0 1 1 × A0 0 1 0 1 0 1 0 1 × Y D0 D1 D2 D3 D4 D5 D6 D7 0 D 1 0 C B A A0 A1 A2 D 0 D1 D 2 D 3 D 4 D 5 D6 D 7 DIS CC4512 Y INH F 图 4.1 3 / 41 考研专业课研发中心

1

× × × × 高阻 2. 如图4.2电路由CMOS传输门构成。试写出输出端的逻辑表达式。（8分）

VDD VDD TG & 1 A F1 100K TG & 1 A 图4.2 TG & 1 B F2 100K

3． 试分析图4.3所示时序电路。（8分） (1) 该电路是同步的还是异步的？

(2) 列出状态转移表和画出状态转移图，并说明电路的逻辑功能。

五、设计题（30分）

1． 设计一个PLA形式的全减器。设A为被减数，B为减数，C为低位借位，差为D，向高位的借位为CO。

完成对PLA逻辑阵列图的编程。（10分）

A B C 或阵列 或阵列 图5.1 PLA逻辑阵列图 D CO

2． 试用555定时器设计一个多谐振荡器，要求输出脉冲的振荡频率为500 Hz，占空比等于60％，积分电

容等于1000 pF。（10分） （1）画出电路连接图； （2）画出工作波形图； （3）计算R1、R2的取值。

3． 用中规模集成十六进制同步计数器74161设计一个13进制的计数器。要求计数器必须包括状态0000

和1111，并且利用CO端作13进制计数器的进位输出。74161的功能表如下，可以附加必要的门电路（10分）

74161功能表 4 / 41 考研专业课研发中心

D0 D1 D2 D3 EP CO ET 74161 CP LD RD Q0 Q1 Q2 Q3 图5.2

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输 入 输 出 RD LD ET EP CP D0 D1 D2 D3 Q0 Q1 Q2 Q3 0 ? ? ? ? ? ? ? ? 0 0 0 0 1 0 ? ? ? d0 d1 d2 d3 d0 d1 d2 d3 1 1 1 1 ? ? ? ? ? 计 数 1 1 0 ? ? ? ? ? ? 保 持, CO =0 1 1 1 0 ? ? ? ? ? 保 持

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